標(biāo)題：allegro軟件的絕對(duì)傳輸延遲是什么，絕對(duì)傳輸延遲應(yīng)該怎么設(shè)置呢？

我們?cè)谟胊llegro進(jìn)行PCB設(shè)計(jì)完成以后，都需要對(duì)一組傳輸?shù)目偩€(xiàn)進(jìn)行時(shí)序等長(zhǎng)，在做時(shí)序等長(zhǎng)的時(shí)候，分為絕對(duì)傳輸延遲與相對(duì)傳輸延遲。絕對(duì)傳輸延遲，顧名思義，信號(hào)傳輸在PCB設(shè)計(jì)中都是有一個(gè)走線(xiàn)的長(zhǎng)度，我們通過(guò)設(shè)置這個(gè)信號(hào)線(xiàn)傳輸?shù)淖畲笾蹬c最小值，來(lái)實(shí)現(xiàn)等長(zhǎng)的方法，就稱(chēng)之為絕對(duì)傳輸延遲。一般情況下如果信號(hào)是從一個(gè)點(diǎn)傳輸?shù)搅硪粋€(gè)點(diǎn)，中間沒(méi)有任何的串阻、串容，這個(gè)絕對(duì)傳輸延遲的方法還是非常有效而卻直觀的。具體在PCB中設(shè)置絕對(duì)傳輸延遲的方法如下所示：

第一步，打開(kāi)規(guī)則管理器，執(zhí)行菜單命令Setup-Constraints，在下拉菜單中選擇Constraint Manager，如圖5-90所示，進(jìn)入到規(guī)則管理器中；

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圖5-90 規(guī)則管理器示意圖

第二步，進(jìn)入規(guī)則管理器以后，在CM左側(cè)的目錄欄中選擇Net，在Routing中選擇Total Etch Length，如圖5-91所示，設(shè)置信號(hào)的線(xiàn)的總長(zhǎng)度；

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圖5-91 設(shè)置絕對(duì)長(zhǎng)度示意圖

第三步，進(jìn)入到右邊欄，對(duì)需要做等長(zhǎng)的信號(hào)線(xiàn)，創(chuàng)建好Bus，在Total Etch Length中輸入最小值、最大值即可，如圖5-92所示，每一組的信號(hào)線(xiàn)都會(huì)跟這個(gè)對(duì)比產(chǎn)生相對(duì)應(yīng)的誤差，按這個(gè)誤差做等長(zhǎng)即可；

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圖5-92 設(shè)置絕對(duì)長(zhǎng)度最大值最小值示意圖

第四步，回到PCB界面，如果需要做等長(zhǎng)的信號(hào)線(xiàn)沒(méi)有滿(mǎn)足最小值或者最大值的要求，都會(huì)報(bào)相對(duì)應(yīng)的DRC錯(cuò)誤，用于提醒工程師做等長(zhǎng)設(shè)計(jì)。

上述，就是在Allegro軟件中，如何設(shè)置絕對(duì)傳輸延遲的方法解析。