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半導體工藝演進對DRAM、邏輯器件和NAND的影響

電子設計 ? 來源:電子設計 ? 作者:電子設計 ? 2020-12-26 01:23 ? 次閱讀

近期筆者在清洗業務研討會上發表了演講。我不是一名清洗工藝專家,在演講中介紹更多的是制造工藝的發展趨勢及其對清洗的影響。我將在這篇文章中分享并進一步討論那次演講的內容,主要圍繞DRAM、邏輯器件和NAND這三大尖端產品。

DRAM

在DRAM章節的第一張幻燈片中,我按公司和年份呈現了DRAM工藝節點的變化。美光科技、三星和SK海力士是DRAM市場的主導廠商,所以我以這三家公司為代表展示了其各自的工藝節點。DRAM節點尺寸目前是由器件上最小的半間距來定義的,美光DRAM基于字線,三星和SK海力士則基于主動晶體管

圖表下方在一定程度上展示了關鍵技術的發展情況。左側展示了具有掩埋字線的鞍形鰭片存取晶體管。具有掩埋字線的鞍形鰭片是目前存取晶體管的標準。在中間和右下角,顯示了DRAM電容器向更細節距-高長寬比結構的演變。

影響DRAM工藝縮減的主要問題是電容。為了可靠地存儲數據,電容需要大于一定的閾值。要繼續制造出占用面積更小的電容,可以把電容做得更高,薄膜更薄,或者增加薄膜的K值。但是問題在于,雖然從機械穩定性的角度還可以可靠地做出更高更薄的電容,但是隨著薄膜厚度的降低,漏電會增加,而且隨著薄膜K值的增加,帶隙減小也會導致漏電問題。當前的標準是使用低漏電的鋁基氧化物薄膜和用于高k值的鋯基薄膜組成的復合膜,而且目前還不清楚是否還會有更好的替代方案。

在第五張和第六張幻燈片中,我介紹了一些主要的DRAM工藝塊,并討論了DRAM工藝對清洗和濕條帶的需求。

我在DRAM章節最后一張幻燈片中展示了三星工藝節點的清洗次數??梢钥闯?,隨著工藝尺寸的縮減,DRAM清洗次數也在增加,這主要是因為在沉浸光刻步驟后需要進行更多次背面斜面清潔,而且越來越復雜的多層圖案化方案也會造成多次清洗。

審核編輯:符乾江
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