在线观看www成人影院-在线观看www日本免费网站-在线观看www视频-在线观看操-欧美18在线-欧美1级

0
  • 聊天消息
  • 系統(tǒng)消息
  • 評(píng)論與回復(fù)
登錄后你可以
  • 下載海量資料
  • 學(xué)習(xí)在線課程
  • 觀看技術(shù)視頻
  • 寫文章/發(fā)帖/加入社區(qū)
會(huì)員中心
創(chuàng)作中心

完善資料讓更多小伙伴認(rèn)識(shí)你,還能領(lǐng)取20積分哦,立即完善>

3天內(nèi)不再提示

模擬前端時(shí)序、ADC時(shí)序和數(shù)字接口時(shí)序中的信號(hào)鏈考慮因素

星星科技指導(dǎo)員 ? 來源:ADI ? 作者:Padraic O’Reilly ? 2022-12-13 11:20 ? 次閱讀

本文介紹了在低功耗系統(tǒng)中降低功耗同時(shí)保持測(cè)量和監(jiān)控應(yīng)用所需的精度的時(shí)序因素和解決方案。它解釋了當(dāng)所選ADC是逐次逼近寄存器(SAR)ADC時(shí)影響時(shí)序的因素。對(duì)于Σ-Δ(∑-Δ)架構(gòu),時(shí)序考慮因素有所不同(請(qǐng)參閱本系列文章的第1部分)。本文探討了模擬前端時(shí)序、ADC時(shí)序和數(shù)字接口時(shí)序中的信號(hào)鏈考慮因素。

模擬前端時(shí)序注意事項(xiàng)

圖1中的這三個(gè)模塊可以從模擬前端(AFE)開始獨(dú)立查看。信號(hào)鏈的類型會(huì)改變AFE,但有一些常見的方面可以適用于大多數(shù)電路。

448552-fig-01.svg?h=270&hash=1433A9F1146FB4BA3090AA46BEF40442&imgver=1

圖1.多路復(fù)用SAR ADC的AFE時(shí)序考慮因素

圖2顯示了構(gòu)成AFE的AD4696 SAR ADC、外部放大器和低通濾波器。AD4696是一款16位、1 MSPS多路復(fù)用SAR ADC,具有輕松驅(qū)動(dòng)?功能。雖然需要外部放大器和電路與外部傳感器連接,但 Easy Drive 模擬輸入高阻模式和參考輸入高阻模式等功能降低了模擬輸入和參考驅(qū)動(dòng)要求。在高功率應(yīng)用中,SAR ADC的抗混疊濾波器設(shè)計(jì)需要具有侵略性,但對(duì)于低帶寬信號(hào)采樣(典型的低功耗應(yīng)用),濾波器設(shè)計(jì)要求較低。Σ-Δ架構(gòu)的好處是,我們可以依靠數(shù)字濾波器來確定頻率響應(yīng),并使用外部抗混疊濾波器在調(diào)制器頻率下進(jìn)行濾波。在沒有過采樣和固有濾波特性的情況下,需要一個(gè)外部模擬低通濾波器,以防止采樣速率以上存在的任何高頻信號(hào)混疊到通帶中。低通濾波器還用于降低來自模擬前端電路的寬帶噪聲,減少模擬輸入端發(fā)生的非線性電壓反沖,并保護(hù)模擬輸入免受過壓事件的影響。同樣的原則也適用于時(shí)間考慮。請(qǐng)參閱文章“低功耗精密信號(hào)鏈應(yīng)用最重要的時(shí)序因素是什么?第 1 部分。

SAR ADC在采樣時(shí)集成了采樣保持機(jī)制,該機(jī)制是一個(gè)開關(guān)和一個(gè)電容,用于捕獲輸入信號(hào),直到收集到轉(zhuǎn)換。

448552-fig-02.svg?h=270&hash=42FAFE667631EB0FBBD473E1A1A10CBE&imgver=1

圖2.AD4696 SAR ADC,內(nèi)置外部反沖RC濾波器和驅(qū)動(dòng)器放大器。

放大器級(jí)的設(shè)計(jì)是一個(gè)兩步過程。第一步是選擇信號(hào)調(diào)理放大器和外部抗混疊級(jí),類似于本系列文章第1部分中討論的內(nèi)容。下一步是選擇一個(gè)外部驅(qū)動(dòng)放大器(其帶寬由增益決定;請(qǐng)記住,存在功率與帶寬的權(quán)衡),該放大器將緩沖信號(hào)調(diào)理抗混疊濾波器輸出并驅(qū)動(dòng)ADC輸入。下一步是設(shè)計(jì)采用總電容C的反沖濾波器內(nèi)線+ C代數(shù)轉(zhuǎn)換器作為我們?yōu)V波器的總電容。

多路復(fù)用SAR ADC在模擬輸入通道之間切換時(shí)存在反沖問題。每次閉合開關(guān)時(shí),電容內(nèi)部電壓(C代數(shù)轉(zhuǎn)換器) 可能與先前存儲(chǔ)在采樣電容器上的電壓不同 (C內(nèi)線).當(dāng)這些開關(guān)由于差異而閉合時(shí),會(huì)發(fā)生電壓毛刺。能量將在它們之間共享,電容器端子之間測(cè)量的電壓將減半。該 C內(nèi)線和 C代數(shù)轉(zhuǎn)換器值會(huì)影響濾波器設(shè)計(jì),在設(shè)計(jì)電路時(shí)需要考慮這些值。AD4696數(shù)據(jù)手冊(cè)詳細(xì)介紹了反沖和ADC驅(qū)動(dòng)器的選擇。此外,還提供ADC驅(qū)動(dòng)器工具以及有用的培訓(xùn)視頻。

448552-fig-03.svg?h=270&hash=6B7D2BCCA452D37466931262506F68B4&imgver=1

圖3.高阻模式對(duì)反沖的影響。

AD4696內(nèi)置模擬輸入高阻態(tài)模式。這顯著降低了電壓反沖幅度,如圖3所示。模擬輸入高阻態(tài)模式還降低了前端放大器和AD4696模擬輸入之間的串聯(lián)電阻引起的性能下降,與傳統(tǒng)的多路復(fù)用SAR ADC相比,允許外部RC濾波器中的電阻更大。使用較大的 R內(nèi)線使用較小的 C內(nèi)線減輕了放大器穩(wěn)定性問題,而不會(huì)顯著影響失真性能,盡管C內(nèi)線如果使能內(nèi)部過壓保護(hù)箝位以避免穩(wěn)定性問題,則建議最小值為 500 pF。圖3顯示,我們可以更快地對(duì)所需信號(hào)進(jìn)行采樣,從而加快系統(tǒng)時(shí)序。

ADC 時(shí)序考慮因素

選擇的ADC將取決于系統(tǒng)中的重要內(nèi)容。有許多文章觸及了在性能方面更適合的主題,并比較了 SAR 和 Σ-deltas 技術(shù)。在低功耗領(lǐng)域,SAR和Σ-Δ測(cè)量相似信號(hào)之間存在大量重疊。有一點(diǎn)很清楚,SAR時(shí)間更易于理解。

448552-fig-04.svg?h=270&hash=8D8E3A02B5B2048D1025BBCE1FE1116B&imgver=1

圖4.AFE SAR 時(shí)間考慮因素。

SAR ADC在某個(gè)時(shí)間點(diǎn)對(duì)輸入進(jìn)行采樣,由采集階段和轉(zhuǎn)換階段組成。在采集階段,采樣保持網(wǎng)絡(luò)或內(nèi)部電容網(wǎng)絡(luò)正在充電(圖 2)。在轉(zhuǎn)換階段,電容陣列切換到比較器網(wǎng)絡(luò),并修改DAC上的權(quán)重,直到達(dá)到與模擬輸入對(duì)應(yīng)的代碼。

448552-fig-05.svg?h=270&hash=B91DD37A1F92C47F7D9EE9F59BC035B6&imgver=1

圖5.典型的SAR ADC時(shí)序。

數(shù)據(jù)手冊(cè)中規(guī)定了最大轉(zhuǎn)換時(shí)間,AD4696的最大轉(zhuǎn)換時(shí)間為415 ns。采集信號(hào)的最短轉(zhuǎn)換時(shí)間為1715 ns,這是AD4696在500 kSPS下工作的采集時(shí)間。轉(zhuǎn)換之間的時(shí)間是吞吐率。

就時(shí)序而言,與SAR ADC相關(guān)的主要權(quán)衡是功耗與ADC采樣速率的關(guān)系。SAR ADC的優(yōu)點(diǎn)是采樣速率和電源電流之間存在直接線性關(guān)系,這意味著它可以根據(jù)目標(biāo)信號(hào)的帶寬進(jìn)行擴(kuò)展。內(nèi)部ADC內(nèi)核在兩次轉(zhuǎn)換之間關(guān)斷,因此在較低采樣速率(例如10 kSPS)下工作時(shí),AD4696的典型功耗為0.17 mW,而1 MSPS時(shí)功耗為8 mW,因此該器件適合采樣速率較低的電池供電應(yīng)用。

448552-fig-06.svg?h=270&hash=5C080C773B1AEEA33432F38FE3DF6D97&imgver=2

圖6.VDD電流與采樣率。

圖 6 顯示了 VDD當(dāng)前。如果我們將AD4696的采樣速率降低到低于100 kSPS的范圍內(nèi),而不是在500 kSPS范圍內(nèi)工作,則我們的DD電流從近 2.5 mA 降至 0.5 mA。如果我們將電流進(jìn)一步降低到10 kSPS,我們的典型IDD電流將降低到42 μA。電流的增加速率是線性的。所有數(shù)字和模擬電源電流均以類似的線性方式縮放,這使得SAR ADC成為使用同一器件測(cè)量DC-AC信號(hào)的有吸引力的提議。

數(shù)字接口時(shí)序注意事項(xiàng)

AD4696有幾個(gè)傳統(tǒng)上與SAR ADC相關(guān)的特性,可以幫助低功耗信號(hào)鏈設(shè)計(jì)人員實(shí)現(xiàn)額外的節(jié)能,但具有時(shí)序影響。

448552-fig-07.svg?h=270&hash=85A79BC12273F716287853691DB69E21&imgver=1

圖7.SAR 數(shù)字接口時(shí)序注意事項(xiàng)。

與Σ-Δ架構(gòu)相比,SAR ADC的吞吐速率更容易 計(jì)算為過濾器延遲不需要考慮:

448552-eq-01.svg?la=en&imgver=1

CHs = 啟用的通道數(shù)。

周期時(shí)間是CNV上升沿轉(zhuǎn)換之間的時(shí)間,由采集和轉(zhuǎn)換階段的組合組成,但可能存在重疊。ADC可以在轉(zhuǎn)換階段仍在進(jìn)行時(shí)開始采集信號(hào)。SAR ADC上的采樣間隔時(shí)間可以描述為周期時(shí)間t中青或采樣率時(shí)間 t鍶.

t轉(zhuǎn)換= 轉(zhuǎn)換時(shí)間 tACQ= 采集時(shí)間

t中青= t鍶= 采樣頻率的倒數(shù),采樣間隔時(shí)間

轉(zhuǎn)換發(fā)生的采樣時(shí)刻由CNV信號(hào)上升沿控制。在大多數(shù)模式下,這是由外部信號(hào)提供的。AD4696還具有片內(nèi)自動(dòng)循環(huán)模式,可在內(nèi)部生成轉(zhuǎn)換開始信號(hào)。此信號(hào)啟動(dòng)轉(zhuǎn)換。AD4696提供多種時(shí)序控制器模式,允許用戶以預(yù)定義的方式選擇轉(zhuǎn)換的順序和配置,或者在不中斷轉(zhuǎn)換的情況下即時(shí)控制序列中的下一個(gè)通道。

數(shù)字主機(jī)必須在下一次轉(zhuǎn)換開始之前讀回?cái)?shù)據(jù)。因此,對(duì)于高速信號(hào),SCK頻率必須足夠快,以便在下一個(gè)CNV上升沿之前從AD4696 SPI讀回?cái)?shù)據(jù)(或在自動(dòng)循環(huán)模式下進(jìn)行內(nèi)部轉(zhuǎn)換啟動(dòng)信號(hào))。更快的采樣率需要更快的SCK頻率,因?yàn)檗D(zhuǎn)換之間的時(shí)間更短。

所需的最小SCK頻率是采樣速率、SPI幀長度(以位為單位)和所用串行數(shù)據(jù)輸出模式的函數(shù)。給定樣本的轉(zhuǎn)換結(jié)果在下一個(gè)轉(zhuǎn)換階段開始之前可用。因此,SCK頻率必須足夠快,以便在下一個(gè)CNV上升沿(或啟用自動(dòng)循環(huán)模式時(shí)的內(nèi)部轉(zhuǎn)換啟動(dòng)信號(hào))之前從AD4696 SPI讀取數(shù)據(jù)。

多個(gè)SDO數(shù)字輸出

AD4696系列還包括雙通道SDO和四通道SDO模式。在這些模式下,ADC結(jié)果在SDO和額外的GPIO引腳上并聯(lián)。這些模式通過將每個(gè)SCK周期SPI上輸出的位數(shù)增加一倍或四倍,顯著降低給定采樣速率所需的SCK頻率。這降低了對(duì)微控制器的要求,當(dāng)以1 MSPS進(jìn)行轉(zhuǎn)換時(shí),將所需的時(shí)鐘從32 MHz SPI時(shí)鐘降低到16 MHz SPI時(shí)鐘。

每個(gè)轉(zhuǎn)換模式幀所需的 SCK 周期數(shù) (NSCK) 是每幀位數(shù) (N ) 的函數(shù)位) 和串行數(shù)據(jù)輸出的數(shù)量 (N性別歧視條例):

448552-eq-02.svg?la=en&imgver=1

其中 N性別歧視條例單 SDO 模式為 1,雙 SDO 模式為 2,四 SDO 模式為 4。

轉(zhuǎn)換模式 SPI 幀的開始不得發(fā)生在 t 之前轉(zhuǎn)換時(shí)間已過,必須盡早完成以遵守最低要求南科華網(wǎng)規(guī)范。在轉(zhuǎn)換模式下完成SPI幀的時(shí)間量(t框架) 的計(jì)算方法如下:

t框架= t中青– 噸CONVERT_max– 噸南科華網(wǎng)

其中 t中青是采樣周期,tCONVERT_max是最大值,t轉(zhuǎn)換是規(guī)范,并且南科華網(wǎng)是 SCK 至 CNV 上升沿延遲規(guī)范。

該 fSCK是 T 的函數(shù)框架和 NSCK.

448552-eq-03.svg?la=en&imgver=1

AD4696數(shù)據(jù)手冊(cè)附表,其中給出了最小SCLK頻率與幾種采樣速率的關(guān)系示例。

自動(dòng)循環(huán)模式

傳統(tǒng)上,對(duì)于電壓或電流電平監(jiān)控應(yīng)用,SAR ADC需要主機(jī)控制器連續(xù)發(fā)出轉(zhuǎn)換信號(hào)以進(jìn)行轉(zhuǎn)換。系統(tǒng)需要檢查數(shù)據(jù)的閾值,并根據(jù)這些級(jí)別做出決策。這不節(jié)能,因?yàn)檫@意味著主機(jī)需要不斷轉(zhuǎn)換。AD4696可配置為根據(jù)用戶編程的通道序列進(jìn)行自主轉(zhuǎn)換。

自動(dòng)循環(huán)模式是用于監(jiān)視模擬輸入的絕佳模式。轉(zhuǎn)換周期有多種選擇,范圍從10 μs(100 kSPS采樣率)到800 μs(1.25 kSPS采樣率)。此模式可與閾值和滯后檢測(cè)警報(bào)結(jié)合使用,這些警報(bào)可基于每個(gè)通道進(jìn)行配置,以減少數(shù)字主機(jī)系統(tǒng)的開銷。在這種情況下,主機(jī)控制器可以進(jìn)入低功耗狀態(tài),只有在觸發(fā)電平時(shí)收到AD4696的中斷時(shí)才會(huì)上電。

過采樣

過采樣和抽取是Σ-Δ架構(gòu)固有的,如本系列文章的第1部分所示。AD4696 SAR ADC內(nèi)置過采樣和抽取引擎,可進(jìn)一步降低噪聲。它有效地對(duì)連續(xù)的ADC樣本求平均值,以產(chǎn)生具有更高有效分辨率和更低噪聲的過采樣結(jié)果。AD4696的過采樣比(OSR)每增加4倍,有效位數(shù)就會(huì)增加1位。

這在測(cè)量需要更高精度的低功率信號(hào)鏈應(yīng)用中的較慢移動(dòng)信號(hào)(例如溫度)時(shí)特別有用。

448552-eq-04.svg?la=en&imgver=1

其中 t樣本= 采樣周期,t中青= 周期時(shí)間(1/采樣率),OSR = 過采樣率(可編程值介于 4 和 64 之間)。

與Σ-Δ型ADC類似,需要在性能和速度之間進(jìn)行權(quán)衡。

主題 時(shí)序注意事項(xiàng) 低功耗信號(hào)鏈影響
抗混疊濾波器 可能存在影響首次轉(zhuǎn)化結(jié)果的延遲 與高速信號(hào)鏈相比,所需的強(qiáng)濾波更少
高阻態(tài)模式 切換通道時(shí)減少反沖時(shí)間 功率隨采樣率縮放;更少的外部電路
電流與采樣率 降低功耗會(huì)降低采樣率 降低采樣率會(huì)降低功耗
自動(dòng)循環(huán)模式 軟件可配置的內(nèi)部轉(zhuǎn)換啟動(dòng) 主機(jī)控制器可以進(jìn)入低功耗狀態(tài)
雙SDO和四SDOSDO 在更高的采樣率下,回讀單個(gè)SDO無法實(shí)現(xiàn)的所有數(shù)據(jù) 額外電路和數(shù)據(jù)速度之間的權(quán)衡
過采樣 樣本之間的間隔隨著過采樣的增加而增加 提高OSR可提高噪聲和分辨率性能

低功耗精密平臺(tái)

隨著全球能源成本趨勢(shì)的增加,我們了解了能源使用對(duì)自然界的影響,系統(tǒng)設(shè)計(jì)人員正在努力以降低功率預(yù)算實(shí)現(xiàn)精度。研究和找到可用的最低功耗組件可能很困難。ADI公司采用我們功耗最低的精密元件,并提供一站式信號(hào)鏈和電路,為系統(tǒng)設(shè)計(jì)人員提供最新產(chǎn)品,從而簡化設(shè)計(jì)過程。

pYYBAGOX73WAKZW5AACz7InDGvU518.jpg?h=270&hash=9920632CD50BF22E31BAB2527BB35809&imgver=1

圖8.精密低功耗信號(hào)鏈網(wǎng)頁。

示例:低功耗SAR信號(hào)鏈

許多應(yīng)用需要在大直流失調(diào)或共模電壓之上測(cè)量小信號(hào)。如果系統(tǒng)的目的是監(jiān)測(cè)工業(yè)環(huán)境中的流量或進(jìn)行生物電勢(shì)測(cè)量,則該方法存在重疊。這些信號(hào)通常需要交流耦合來消除較大的失調(diào)以及偏置和增益,以最大化ADC的動(dòng)態(tài)范圍。

我們的低功耗精密信號(hào)鏈包括為此類應(yīng)用選擇哪些器件的建議。

448552-fig-09.svg?h=270&hash=623336738CD5A4EF614E4B1369EBE745&imgver=1

圖9.信號(hào)鏈?zhǔn)纠?/strong>

此外,集成知識(shí)專有技術(shù) (KWIK) 電路提供更深入的電路分析以及有關(guān)最新組件選擇的最新建議。

流量信號(hào)鏈?zhǔn)纠?/strong>

舉個(gè)例子,我們想設(shè)計(jì)一個(gè)大型多重測(cè)量系統(tǒng),其中包括使用圖10所示的KWIK電路進(jìn)行流量測(cè)量。

(A) 我想以 1 kSPS 的速度運(yùn)行 10 個(gè)流量傳感器。SAR 還是 sigma-delta 是更好的選擇?

(B) AFE的時(shí)間考慮是什么?

448552-fig-10.svg?h=270&hash=455CD8FA24D571A448CD093A3F4D7B92&imgver=2

圖 10.流量測(cè)量信號(hào)鏈KWIK電路。

一個(gè)。SAR(AD4696)與信號(hào)調(diào)理所需的AD8235和ADA4505-2放大器是最佳選擇,因?yàn)槲覀兛梢允褂猛獠哭D(zhuǎn)換信號(hào)或自動(dòng)循環(huán)模式以10 kSPS運(yùn)行10個(gè)通道。

B.在這種情況下,AD4505-2放大器的響應(yīng)與增益的關(guān)系將決定被測(cè)信號(hào)的帶寬,而不是抗混疊濾波器的響應(yīng)。高阻態(tài)模式將減輕輸入放大器性能的壓力,使設(shè)計(jì)人員能夠選擇低功耗放大器。選擇圖10中的元件是因?yàn)槠涑凸男阅堋?/p>

結(jié)論

在設(shè)計(jì)高分辨率低功耗數(shù)據(jù)采集系統(tǒng)時(shí),可能很難找到功耗最低的元件,而ADI公司的精密低功耗信號(hào)鏈?zhǔn)堑凸脑O(shè)計(jì)的起點(diǎn)。在形成采用Σ-Δ和SAR架構(gòu)作為其核心ADC的信號(hào)鏈時(shí),必須謹(jǐn)慎理解時(shí)序上的權(quán)衡和差異。

與傳感器或目標(biāo)信號(hào)接口時(shí),模擬前端時(shí)序需要考慮芯片級(jí)啟動(dòng)、傳感器偏置、外部濾波和元件選擇。抗混疊濾波器對(duì)SAR ADC的要求更高,因?yàn)棣?Δ型ADC具有與其設(shè)計(jì)相關(guān)的固有采樣。在AFE上,Σ-Δ型ADC集成了PGA,而高阻態(tài)模式等SAR技術(shù)正在放寬對(duì)外部放大器電路的驅(qū)動(dòng)要求。

當(dāng)我們考慮Σ-Δ型ADC架構(gòu)時(shí),過采樣和抽取以及濾波器延遲會(huì)影響吞吐速率,尤其是在多個(gè)通道上轉(zhuǎn)換時(shí)。另一方面,由于采用逐次逼近方法,SAR吞吐量的計(jì)算更加簡單,其附加好處是采樣速度越慢,轉(zhuǎn)換時(shí)消耗的電流越低。

Σ-Δ AD4130-8數(shù)字時(shí)序的復(fù)雜性促使ACE軟件時(shí)序工具的開發(fā)。這些可用于簡化理解并幫助計(jì)算通道吞吐率。同一器件具有占空比、FIFO和待機(jī)模式等定時(shí)功能,以幫助延長電池壽命,但在針對(duì)特定吞吐速率時(shí),在考慮可實(shí)現(xiàn)的有效分辨率時(shí)必須小心。

當(dāng)我們檢查像AD4696這樣的SAR ADC時(shí),我們可以在更高的采樣頻率下進(jìn)行采樣。這有其優(yōu)勢(shì),但這意味著數(shù)字時(shí)間框架,t框架,其中您需要回讀的較小,這意味著需要更快的SPI時(shí)鐘速度。

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請(qǐng)聯(lián)系本站處理。 舉報(bào)投訴
  • 放大器
    +關(guān)注

    關(guān)注

    143

    文章

    13589

    瀏覽量

    213471
  • 濾波器
    +關(guān)注

    關(guān)注

    161

    文章

    7816

    瀏覽量

    178111
  • SAR
    SAR
    +關(guān)注

    關(guān)注

    3

    文章

    416

    瀏覽量

    45957
  • adc
    adc
    +關(guān)注

    關(guān)注

    98

    文章

    6498

    瀏覽量

    544629
收藏 人收藏

    評(píng)論

    相關(guān)推薦

    優(yōu)化高速接口時(shí)序裕量

    本文將對(duì)源同步定時(shí)如何優(yōu)化高速接口時(shí)序裕量進(jìn)行討論。時(shí)序預(yù)算是對(duì)系統(tǒng)正常工作所需時(shí)序參數(shù)或時(shí)序要求的計(jì)算。
    發(fā)表于 03-20 10:46 ?2648次閱讀
    優(yōu)化高速<b class='flag-5'>接口</b>的<b class='flag-5'>時(shí)序</b>裕量

    同步電路設(shè)計(jì)靜態(tài)時(shí)序分析的時(shí)序約束和時(shí)序路徑

    同步電路設(shè)計(jì)時(shí)序是一個(gè)主要的考慮因素,它影響了電路的性能和功能。為了驗(yàn)證電路是否能在最壞情況下滿足時(shí)序要求,我們需要進(jìn)行靜態(tài)
    發(fā)表于 06-28 09:35 ?1134次閱讀
    同步電路設(shè)計(jì)<b class='flag-5'>中</b>靜態(tài)<b class='flag-5'>時(shí)序</b>分析的<b class='flag-5'>時(shí)序</b>約束和<b class='flag-5'>時(shí)序</b>路徑

    模擬時(shí)序控制解決方案:可靠的上電和關(guān)斷時(shí)序

    進(jìn)行監(jiān)控。當(dāng)所有電壓建立之后,時(shí)序控制器電路產(chǎn)生電源良好信號(hào)模擬時(shí)序控制解決方案(如ADM1186-1)很容易使用。它們具備多電壓系統(tǒng)所需的全部功能。
    發(fā)表于 04-12 07:00

    時(shí)序約束與時(shí)序分析 ppt教程

    時(shí)序約束與時(shí)序分析 ppt教程 本章概要:時(shí)序約束與時(shí)序分析基礎(chǔ)常用時(shí)序概念QuartusII
    發(fā)表于 05-17 16:08 ?0次下載

    FPGA設(shè)計(jì)時(shí)序管理問題

    一、摘要 從簡單SRAM接口到高速同步接口,TimingDesigner軟件允許設(shè)計(jì)者在設(shè)計(jì)流程的初期就判斷出潛在的時(shí)序問題,盡最大可能在第一時(shí)間解決時(shí)序問題。在設(shè)計(jì)過程的早期檢測(cè)到
    發(fā)表于 01-13 16:25 ?103次下載
    FPGA設(shè)計(jì)<b class='flag-5'>中</b>的<b class='flag-5'>時(shí)序</b>管理問題

    FPGA時(shí)序約束簡介

    在簡單電路,當(dāng)頻率較低時(shí),數(shù)字信號(hào)的邊沿時(shí)間可以忽略時(shí),無需考慮時(shí)序約束。但在復(fù)雜電路,為了減少系統(tǒng)
    的頭像 發(fā)表于 03-30 13:42 ?1.5w次閱讀
    FPGA<b class='flag-5'>時(shí)序</b>約束簡介

    雙 CAN 收發(fā)器的時(shí)序考慮

    雙 CAN 收發(fā)器的時(shí)序考慮
    發(fā)表于 11-15 19:45 ?6次下載
    雙 CAN 收發(fā)器的<b class='flag-5'>時(shí)序</b><b class='flag-5'>考慮</b>

    使用SAR ADC構(gòu)建低功耗精密信號(hào)應(yīng)用最重要的時(shí)序因素有哪些?

    本文介紹低功耗系統(tǒng)在降低功耗的同時(shí)保持精度時(shí),所涉及的信號(hào)模擬前端時(shí)序ADC
    的頭像 發(fā)表于 11-23 20:15 ?860次閱讀

    低功耗精密信號(hào)應(yīng)用最重要的時(shí)序因素是什么

    信號(hào)的第一個(gè)時(shí)序考慮因素是偏置/激勵(lì)傳感器和為信號(hào)
    的頭像 發(fā)表于 12-13 11:33 ?780次閱讀
    低功耗精密<b class='flag-5'>信號(hào)</b><b class='flag-5'>鏈</b>應(yīng)用最重要的<b class='flag-5'>時(shí)序</b><b class='flag-5'>因素</b>是什么

    靜態(tài)時(shí)序分析的基本概念和方法

    向量和動(dòng)態(tài)仿真 。本文將介紹靜態(tài)時(shí)序分析的基本概念和方法,包括時(shí)序約束,時(shí)序路徑,時(shí)序裕量,setup檢查和hold檢查等。 時(shí)序路徑 同步
    的頭像 發(fā)表于 06-28 09:38 ?1529次閱讀
    靜態(tài)<b class='flag-5'>時(shí)序</b>分析的基本概念和方法

    淺談時(shí)序設(shè)計(jì)和時(shí)序約束

    ??本文主要介紹了時(shí)序設(shè)計(jì)和時(shí)序約束。
    的頭像 發(fā)表于 07-04 14:43 ?1419次閱讀

    時(shí)序仿真與功能仿真的區(qū)別有哪些?

    EDA仿真,它模擬一個(gè)數(shù)字電路時(shí)序的行為。時(shí)序行為通常包括數(shù)據(jù)信號(hào)傳輸?shù)?/div>
    的頭像 發(fā)表于 09-17 14:15 ?6277次閱讀

    數(shù)字電源時(shí)序器的內(nèi)部結(jié)構(gòu)與數(shù)字電源時(shí)序器的常見故障

    數(shù)字電源時(shí)序器的內(nèi)部結(jié)構(gòu)與數(shù)字電源時(shí)序器的常見故障 數(shù)字電源時(shí)序器是一種用于測(cè)試和
    的頭像 發(fā)表于 10-16 16:16 ?3028次閱讀

    時(shí)序電路的分類 時(shí)序電路的基本單元電路有哪些

    時(shí)序電路是一種能夠按照特定的順序進(jìn)行操作的電路。它以時(shí)鐘信號(hào)為基準(zhǔn),根據(jù)輸入信號(hào)的狀態(tài)和過去的狀態(tài)來確定輸出信號(hào)的狀態(tài)。時(shí)序電路廣泛應(yīng)用于計(jì)
    的頭像 發(fā)表于 02-06 11:25 ?2593次閱讀

    高速ADC與FPGA的LVDS數(shù)據(jù)接口中避免時(shí)序誤差的設(shè)計(jì)考慮

    電子發(fā)燒友網(wǎng)站提供《高速ADC與FPGA的LVDS數(shù)據(jù)接口中避免時(shí)序誤差的設(shè)計(jì)考慮.pdf》資料免費(fèi)下載
    發(fā)表于 10-15 09:50 ?5次下載
    高速<b class='flag-5'>ADC</b>與FPGA的LVDS數(shù)據(jù)<b class='flag-5'>接口</b>中避免<b class='flag-5'>時(shí)序</b>誤差的設(shè)計(jì)<b class='flag-5'>考慮</b>
    主站蜘蛛池模板: 日本黄色站| 美女黄视频免费| 国产五月婷婷| 免费看大美女大黄大色| 午夜免费网址| 日本大片免费一级| 午夜免费片| 亚洲一区二区视频在线观看| 日韩欧免费一区二区三区| 在线片视频网站| 在线二区| 欧美日韩一区二区不卡| 日本在线网址| 国内精品99| 国内免费视频成人精品| 国产天美| 婷婷综合在线观看丁香| 成人黄色激情网| 欧美xxxx性疯狂bbbb| 色婷婷色综合缴情在线| 网色视频| 国产精品高清久久久久久久| 精品国产你懂的在线观看| 国产精品福利一区二区亚瑟| 亚洲人成影网站~色| 国产69精品久久久久9999| 五月丁香啪啪| 日本精品一卡二卡≡卡四卡| 天天干在线免费视频| 99热.com| www.jizz中国| 欧美成人免费高清网站| 精品国产一二三区在线影院 | 2019天天干| 色黄污在线看黄污免费看黄污| 天天爽天天爽| 亚洲天堂网站| 午夜在线观看免费高清在线播放| 免费亚洲一区| www.99在线| 扒开双腿猛进入jk校视频|