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MIPI dsi TX移植注意事項簡單總結

XL FPGA技術交流 ? 來源:XL科技 ? 作者:XL科技 ? 2023-02-06 14:20 ? 次閱讀

MIPI Dsi的使用相比于CSI多了一些寄存器控制,生成的example直接仿真是可以的,但是修改了參數,一些參數也要做相應的調整。這里我們來做個簡單的總結 。

(1)修改配置參數

視頻格式如下,可能根據實際的需要進行修改。

parameter MAX_HRES = 16'd1920;
parameter MAX_VRES = 12'd4;
parameter HSP = 10'd2;
parameter HBP = 10'd2;
parameter HFP = 10'd246;
parameter VSP = 6'd5;
parameter VBP = 6'd8;
parameter VFP = 6'd32;

修改了參數要在Tianium-mipi-utility文件中驗證確保文件沒有錯誤提示。

da2f738e-a3c0-11ed-bfe3-dac502259ad0.png

另外要把Tianium-mipi-utility文件中input fields中的信息替換dsi_tb.mem中的相應信息。這是IP需要的視頻格式信息。

da3ed9d2-a3c0-11ed-bfe3-dac502259ad0.png

另外還在注意在IP中修改所支持的Maximum HorizontalResolution信息,確認我們測試的行長度小于等于該值。

da7407a6-a3c0-11ed-bfe3-dac502259ad0.png

(2)注意修改相應的時鐘

在下面,i_pclk是單像素的時鐘。o_pclk對應MIPI接口的像素時鐘。

i_sys_clk是MIPI AXI接口的配置時鐘。i_mipi_tx_pclk是MIPI發送8位HS數據的并行時鐘。

在使用中可能根據設置參數修改i_pclk,o_pclk和i_mipi_tx_pclk;一般不用修改i_sys_clk。

//video生成時鐘是125M
initial
begin
 i_pclk <= 1'b1;
 forever
 #4.00 i_pclk <= ~i_pclk;
end
//轉換成MIPI接口的pixel clock是62.5M
initial begin
 o_pclk <= 1'b1;
 forever #8.00 o_pclk <= ~o_pclk;
end
//MIPI配置接口時鐘是50M
initial begin
 i_sys_clk <= 1'b1;
 forever #10 i_sys_clk <= ~i_sys_clk;
end
//MIPI時是100M
initial begin
 mipi_clk <= 1'b1;
 forever #5 mipi_clk <= ~mipi_clk;
end
//數據速率是1000M
initial begin
 i_mipi_tx_pclk <= 1'b1;
 forever #4 i_mipi_tx_pclk <= ~i_mipi_tx_pclk;
end

(3)所設置的參數即要Tianium-mipi-utility在評估通過,還要滿足公式

PIX_CLK_MHZ < (DATARATE_MPBS * NUM_DATA_LANE) / PACK_BIT,

這里的PIX_CLK_MHZ就是指Tianium-mipi-utility中的像素時鐘,也是單像素時鐘。

DATARATE_MPBS是指MIPI的數據速率,并非video的帶寬。

NUM_DATA_LANE是指傳輸所用的lane數

PACK_BIT如下,詳細信息請參考MIPI DSI ds。

da880cc4-a3c0-11ed-bfe3-dac502259ad0.png

審核編輯:劉清

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原文標題:MIPI dsi TX移植注意事項

文章出處:【微信號:gh_ea2445df5d2a,微信公眾號:FPGA及視頻處理】歡迎添加關注!文章轉載請注明出處。

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