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分享下SpinalHDL中SpinalConfig中的三項(xiàng)參數(shù)

Spinal FPGA ? 來源:Spinal FPGA ? 2023-02-08 10:01 ? 次閱讀

》nameWhenByFile

測試代碼如下:

37195e7a-a713-11ed-bfe3-dac502259ad0.png

當(dāng)我們采用SpinalSystemVerilog(demo0())的方式生成RTL代碼時其生成的代碼風(fēng)格如下:

37538b68-a713-11ed-bfe3-dac502259ad0.png

在SpinalHDL中對于when的使用,when中所包含的條件往往會生成以一個when+fileName+行號的變量來替代,看起來無非代碼多了幾行,并不影響功能。

因?yàn)橛行刑柕囊耄覀円坏pinalHDL代碼中這部分代碼哪怕是添加了幾行注釋也會引起生成代碼的部分修改,雖然不影響功能,但對于那些喜歡看RTL代碼的人就顯得略顯得不爽了。

對于when的使用,可以在生成RTL代碼時采用下面的形式來生成:

SpinalConfig(
nameWhenByFile=false
  ).generateSystemVerilog(demo0())

生成代碼如下:

378a4efa-a713-11ed-bfe3-dac502259ad0.png

如此生成的代碼不會再對when語句聲明單獨(dú)的變量,代碼看起來和那些采用Verilog寫代碼的人毫無差異吧~

這對于生層的RTL盡可能減少非必要的信號名稱變化。

》genLineComments

更近一步,對于代碼生成時采用下面的形式生成:

  SpinalConfig(
    nameWhenByFile = false,
    genLineComments = true
  ).generateSystemVerilog(demo0())

此時生成的代碼風(fēng)格如下:

37bb7304-a713-11ed-bfe3-dac502259ad0.png

當(dāng)genLineComments聲明為true時,在生成RTL代碼中會標(biāo)注映射對應(yīng)的SpinalHDL代碼行號,這對于初學(xué)者在對比生成的RTL代碼學(xué)習(xí)SpinalHDL還是非常的有幫助~

》bitVectorWidthMax

SpinalHDL中對于信號位寬默認(rèn)是最大不超過4096(Intel DDR校準(zhǔn)控制IP里面就有信號位寬就是4096 bit位寬),當(dāng)設(shè)計里定義了信號 位寬超過4096,則會在生成RTL代碼時報錯,可通過SpianlConfig中的bitVectorWidthMax對最大位寬進(jìn)行修改:

37d2d882-a713-11ed-bfe3-dac502259ad0.png

37fe516a-a713-11ed-bfe3-dac502259ad0.png







審核編輯:劉清

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原文標(biāo)題:SpinalConfig Tips——讓代碼優(yōu)雅點(diǎn)兒

文章出處:【微信號:Spinal FPGA,微信公眾號:Spinal FPGA】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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