HCSL與LP-HCSL的比較分析
HCSL（HCSL--High?speed Current Steering Logic）一般用于PCIE參考時鐘的電平類型，根據規范需要下拉電路，如下圖HCSL之間的DC耦合。HCSL為電流輸出驅動，輸出結構由通常通過50Ω電阻器接地的15 mA開關電流源驅動。 標稱信號擺幅為750 mV。
HCSL規范
HCSL輸入輸出拓撲
1-HCSL端接匹配
HCSL接口通常以50Ω負載源極端接，其中Rs大小一般為33Ω，匹配50Ω阻抗。 一般在輸出端位置。驅動器本身具有17歐姆的輸出阻抗，所以，需要串聯一個33歐姆的電阻，以獲得與50歐姆傳輸線的匹配。對于傳統的HCSL，為了避免出現過度的振鈴，串聯電阻RS是必須要的。
2-LP-HCSL比較
LPHCSL（Low-Power HCSL）是為了降低傳統的HCSL驅動器的功耗而開發的。采用推-拉（push-pull）電壓驅動，電流消耗大約4到5mA。
LP-HCSL輸出功能與幅值對比
HCSL與LP-HCSL端接方式:
LP-HCSL直連即可，少了四個電阻效率高，速度快，支持AC耦合。
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