自中科昊芯推出專題講解SCI串口通信以來(lái)，第一期主要講解SCI串口FIFO通信原理，第二期主要講解SCI串口自動(dòng)波特率，本期主要講解FIFO中斷通信邏輯。

HX2000系列SCI模塊原理與中斷邏輯如下，中斷邏輯為：當(dāng)SCITXBUF數(shù)據(jù)被傳輸?shù)絋XSHF寄存器時(shí)，將通過(guò)SCICTL[TXRDY]產(chǎn)生一個(gè)發(fā)送中斷，使能SCICTL[TXINTENA]打開發(fā)送中斷信號(hào)，將通過(guò)PIE響應(yīng)CPU執(zhí)行，使得CPU可以連續(xù)寫數(shù)據(jù)到SCITXBUF，使得SCI模塊可以向PC端連續(xù)發(fā)送數(shù)據(jù)。當(dāng)SCI接收一個(gè)完整幀，并將RXSHF寄存器中的數(shù)據(jù)傳輸?shù)絊CIRXBUF寄存器中，將通過(guò)SCIRXST[RXRDY]產(chǎn)生一個(gè)接收中斷，使能SCICTL[RXBKINTENA]打開接收中斷信號(hào)，將通過(guò)PIE響應(yīng)CPU執(zhí)行，使得CPU讀取PC端發(fā)送的數(shù)據(jù)幀。

由此設(shè)計(jì)SCI串口FIFO中斷通信實(shí)例：采用SCI與串口CH340，連續(xù)發(fā)送數(shù)據(jù)，PC端接收發(fā)送的數(shù)據(jù)；通過(guò)串口調(diào)試助手，向CPU發(fā)送任意一組數(shù)據(jù)，CPU接收發(fā)送的數(shù)據(jù)。

基于以上分析，在CDK上開發(fā)SCI串口FIFO中斷通信輸出程序，代碼包括：SCI GPIO外設(shè)引腳配置，F(xiàn)IFO功能配置，發(fā)送與接收中斷程序，主程序調(diào)用執(zhí)行。主要代碼如下：

1.intmain(void)2.{3. /*初始化系統(tǒng)控制*/4. InitSysCtrl();5. /*初始化內(nèi)存控制寄存器，使能內(nèi)存流水線模式*/6. InitFlash();7. /*初始化串口通信的GPIO口：GPIO28: SCIRXDA,GPIO29: SCITXDA*/8. InitSciGpio();9. /*不使能CPU中斷*/10. IER=0x0000;11. /*清除所有的CPU中斷標(biāo)志*/12. IFR=0x0000;13. /*初始化中斷向量表*/14. InitPieVectTable();15. EALLOW;16. /*向量表地址SCITXINTA指向執(zhí)行循環(huán)發(fā)送中斷服務(wù)程序*/17. PieVectTable.SCITXINTA=&scia_send;18. /*向量表地址SCIRXINTA指向執(zhí)行接收數(shù)據(jù)中斷服務(wù)程序*/19. PieVectTable.SCIRXINTA=&scia_received;20. EDIS;21. /*SCI寄存器FIFO功能配置*/22. Scia_Config(9600);23. /*打開CPU的IER的第9組中斷向量*/24. IER|=M_INT9;25. /*打開PIEIER的第9組的第一與第二個(gè)中斷向量*/26. PieCtrlRegs.PIEIER9.bit.INTx1=1;27. PieCtrlRegs.PIEIER9.bit.INTx2=1;28. /*使能全局中斷向量*/29. EINT;30. for(;;)31. {}32. return0;33.}

CDK上開發(fā)SCI串口FIFO中斷通信程序，其編譯結(jié)果為：

編譯通過(guò)后，就可以開始調(diào)試了，DSP端連續(xù)發(fā)送數(shù)據(jù)的調(diào)試結(jié)果如下：

PC端發(fā)送數(shù)據(jù)的調(diào)試結(jié)果如下：

調(diào)試后，可通過(guò)串口調(diào)試助手查看發(fā)送與接收到的數(shù)據(jù)如下圖：

關(guān)于中科昊芯

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