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如何將模擬子系統引入RISC-V呢?

冬至子 ? 來源:EETOP ? 作者:Jake Hertz ? 2023-07-03 15:48 ? 次閱讀

當我們提到RISC-V時,我們往往會想到數字電子和計算。雖然兩者之間存在很強的相關性,但仍有許多公司正在開發由 RISC-V 技術提供支持的模擬 IP 解決方案。Agile Analog 就是這樣的一家公司,它以使用數字電子產品創建可配置的模擬 IP 解決方案而聞名。

本周,Agile Analog 宣布將為RISC-V應用推出完整的模擬 IP 子系統,重點放在電池供電物聯網解決方案上。在本文中,我們將了解Agile Analog 的三個 IP 子系統,以及它們將如何使 RISC-V 社區受益。

AgilePMU

Agile Analog 向 RISC-V 生態系統推出的三個 IP 子系統中的第一個是一系列電源管理單元。這些來自 Agile Analog 的電源管理單元稱為agilePMU,是用于SoC/ASIC 的高度集成 PMU。

圖片

agilePMU的框圖。圖片由Agile Analog提供

agilePMU 設計有一個集成數字控制器、兩個可單獨編程的低壓降穩壓器 (LDO) 和一個內部帶隙電壓參考,旨在將 RISC-V 系統的性能與低功耗運行融為一體。該產品旨在監控電力系統的實時狀態并提供反饋以確保最佳系統性能。

AgileSMU

除了 PMU 產品,Agile Analog 還將在其RISC-V 子系統宏中 包含一個稱為agileSMU的睡眠管理單元 (SMU)。

圖片

agile SMU 框圖。圖片由Agile Analog提供

agileSMU 是一種低功耗解決方案,旨在以及時可靠的方式將 SoC 從睡眠模式喚醒,同時最大限度地提高電源效率。為此,agileSMU 由一個范圍從 32 kHz 到 20 MHz 的可編程振蕩器和幾個用于啟動 SoC 喚醒的低功耗比較器(1.5 uA 活動電流)組成。SMU 還包括一個啟動時間為 10 us、斷言時間為 5 us 的上電復位 (POR),以確保 SoC 的啟動復位。

IoT 系統中,由于主 SoC 進入睡眠模式以節省電量,因此該 SMU 可以確保低功耗運行。

Agile傳感器接口

Agile Analog 的 RISC-V 產品組合中包含的三個 IP 子系統中的最后一個是其傳感器接口產品,稱為agileSensorIF。

agileSensorIF 解決方案旨在以高效和高性能的方式實現傳感器與主 SoC 的接口。agileSensorIF 解決方案具有多個集成塊,例如 ADCDAC、低功耗模擬比較器和相關的帶隙發生器。此外,該系統具有集成的配置和控制邏輯,以實現系統的可確認性和控制。

圖片

agileSensorIF的框圖。圖片由Agile Analog提供

與大多數Agile 解決方案一樣,這些模塊中的每一個都是可配置的,包括 ADC 和 DAC 的數量以及它們的位深度和采樣率。達到最大值后,ADC 可以達到 12 位分辨率和 64 MSPS 的采樣率,而 DAC 可以達到 12 位分辨率和 20 MSPS 的速率。

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