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Vivado IP核Shared Logic選項(xiàng)配置

CHANBAEK ? 來(lái)源:FPGA Zone ? 作者:stark ? 2023-09-06 17:05 ? 次閱讀

在給Vivado中的一些IP核進(jìn)行配置的時(shí)候,發(fā)現(xiàn)有Shared Logic這一項(xiàng),這里以Tri Mode Ethernet MAC IP核為例,如圖1所示。

圖片

圖1 IP核Shared Logic選項(xiàng)配置

之前都是默認(rèn)選擇“Include Shared Logic in Core”,一直都沒(méi)考慮過(guò)“Include Shared Logic in Example Design”和“Include Shared Logic in Core”在使用上有什么區(qū)別。

從字面意思來(lái)看,“Include Shared Logic in Example Design”就是在IP核中不包括共享資源,而“Include Shared Logic in Core”則相反。Shared Logic就是共享邏輯,主要包括時(shí)鐘、復(fù)位等。當(dāng)選擇Shared Logic in core時(shí),這些共享的邏輯就會(huì)被集成到IP的內(nèi)部。當(dāng)選擇Shared Logic in example design時(shí),這些共享邏輯信號(hào)作為輸入信號(hào)被IP調(diào)用。至于為什么叫in example design,是因?yàn)閂ivado的IP都會(huì)提供一個(gè)例程,shared logic在example中是對(duì)外開(kāi)放的,可由用戶修改。

圖片

圖2 例化多個(gè)IP核時(shí)shared logic信號(hào)共享連接

如圖2所示,左側(cè)的 IP 核選擇了將共享資源包含在 IP 核內(nèi)部,右側(cè)的 IP 核則選擇了將共享資源從 IP 核內(nèi)部去除, 移至 example desgin 中。兩種選項(xiàng)應(yīng)用場(chǎng)景的區(qū)別主要在于:如果工程中只需要例化1個(gè)該IP核,就選擇“Include Shared Logic in Core”。若需要例化多個(gè)此IP核,就可以令第一個(gè)IP選擇“Include Shared Logic in Core”,將共享資源包含在 IP 核內(nèi)部;其它例化的IP核選擇“Include Shared Logic in Example Design”,將共享資源從 IP 核內(nèi)部去除,并與第一個(gè)IP核信號(hào)共享。

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