Stratix IV內嵌DPA電路的基本結構分析
不論從哪個角度看，今天的現場可編程門陣列(FPGA)，都顯得“鶴立雞群”，真是非常棒的器件。如果在這個智能時代，在這個領域，想擁有一技之長的你還沒有關注FPGA，那么世界將拋棄你，時代將拋棄你。本公眾號作者ALIFPGA，多年FPGA開發經驗，所有文章皆為多年學習和工作經驗之總結。
StratixIV內嵌DPA電路的基本結構
Altera DPA電路特點如下。
可以放松高速接口對時鐘到數據通道和數據通道之間對Skew的嚴格要求。
最高支持1.6Gbit/s應用。
專用硬件DPA 電路實現連續采樣、時鐘對齊等功能。
CDR為可選功能。
AlteraStratix II DPA電路的性能指標.
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原文標題：Stratix IV內嵌DPA電路的基本結構
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