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利用單片機(jī)和FPGA器件實(shí)現(xiàn)等效和實(shí)時(shí)采樣方式的數(shù)字示波器設(shè)計(jì)

電子設(shè)計(jì) ? 來源:郭婷 ? 作者:電子設(shè)計(jì) ? 2019-05-05 08:19 ? 次閱讀

引言

數(shù)字示波器自上個(gè)世紀(jì)七十年代誕生以來,它已成為測(cè)試工程師必備的工具之一。隨著近年來電子技術(shù)取得突破性的進(jìn)展,催生了更龐大的數(shù)字示波器市場(chǎng)需求。此外,信號(hào)傳輸在現(xiàn)代工程中是很重要的一個(gè)技術(shù)環(huán)節(jié),但在信號(hào)傳輸中,數(shù)字信號(hào)將對(duì)模擬信號(hào)產(chǎn)生干擾,目前采用的解決方法是利用單片機(jī)來實(shí)現(xiàn)模擬信號(hào)和數(shù)字信號(hào)在單線中的混合傳輸,而這其中的測(cè)試和調(diào)試就要求示波器必須能夠?qū)?shù)字信號(hào)和模擬信號(hào)同時(shí)進(jìn)行分析和顯示。因此,這里介紹一種基于等效和實(shí)時(shí)采樣數(shù)字示波器的設(shè)計(jì)。

2 設(shè)計(jì)方案

2.1 采樣方案

選擇實(shí)時(shí)采樣和等效采樣相結(jié)合的方式,實(shí)時(shí)采樣速率小于1 MS/s,水平分辨率至少為20點(diǎn)/div,故系統(tǒng)50 kHz以下采用實(shí)時(shí)采樣方式,而50 kHz~10 MHz采用等效時(shí)間采樣方式,最高等效采樣速率可達(dá)到200 Ms/s。

2.2 頻率測(cè)量方案

由于該系統(tǒng)測(cè)試頻率上限為10 MHz。根據(jù)等精度測(cè)量和測(cè)周法原理,將此頻率分為兩段。因此,10 kHz以下頻率段,采用測(cè)周法;10 kHz以上的頻率段,采用等精度測(cè)量法,從而縮短測(cè)量時(shí)間。

2.3 觸發(fā)方案

采用內(nèi)部軟件觸發(fā),通過軟件設(shè)置觸發(fā)電平,軟件設(shè)置的施密特觸發(fā)器參數(shù)容易修改,可以很好抑制比較器產(chǎn)生的毛刺。當(dāng)所采樣值大于該觸發(fā)電平時(shí),產(chǎn)生一次觸發(fā)。該方案可排除硬件產(chǎn)生的毛刺干擾,觸發(fā)和波形較穩(wěn)定,且易實(shí)現(xiàn)觸發(fā)電壓的調(diào)整。

2.4 采樣與保持電路方案

采用射極跟隨器、模擬開關(guān)和電容搭建采樣與保持電路。射極跟隨器可選用帶寬穩(wěn)定且?guī)?dòng)容性負(fù)載強(qiáng)的運(yùn)放,有較多的TI模擬開關(guān),使其速度很容易滿足要求,再選用合適的漏電小的聚苯電容即可實(shí)現(xiàn)采樣與保持電路。

3 系統(tǒng)硬件電路設(shè)計(jì)

系統(tǒng)制定出系統(tǒng)總體方案:輸入信號(hào)經(jīng)阻抗變換電路后進(jìn)行程控放大,再經(jīng)采樣與保持電路后進(jìn)人MAX118進(jìn)行采樣。其中程控放大倍數(shù)和A/D采樣速率由垂直靈敏度和水平掃描速度確定,采樣時(shí)刻由上升沿觸發(fā)判斷和等效采樣控制單元決定。采樣數(shù)據(jù)存入雙端口RAM,顯示控制模塊讀取RAM內(nèi)容并控制DAC904輸出顯示。圖1為系統(tǒng)總體設(shè)計(jì)實(shí)現(xiàn)框圖。

利用單片機(jī)和FPGA器件實(shí)現(xiàn)等效和實(shí)時(shí)采樣方式的數(shù)字示波器設(shè)計(jì)

3.1 程控放大及前級(jí)阻抗匹配

信號(hào)先經(jīng)前級(jí)AD811的阻抗匹配后實(shí)現(xiàn)系統(tǒng)的輸入阻抗為1 MΩ,再經(jīng)過模擬開關(guān)MAX308CPE來實(shí)現(xiàn)不同通道放大的選擇,最后經(jīng)模擬開關(guān)COM總輸出,如圖2所示。

利用單片機(jī)和FPGA器件實(shí)現(xiàn)等效和實(shí)時(shí)采樣方式的數(shù)字示波器設(shè)計(jì)

3.2 采樣與保持電路

基于采樣頻帶要達(dá)到10 MHz,系統(tǒng)采用模擬開關(guān)THS3166,其特點(diǎn)是低導(dǎo)通電阻、電容,低漏電流,低捕獲時(shí)間和通斷孔徑時(shí)間,但只工作在正電壓范圍,故需前級(jí)加法器。開關(guān)前再加一級(jí)射極跟隨器,采用帶動(dòng)容性負(fù)載強(qiáng)寬帶運(yùn)放THS3001做前后級(jí)的隔離。

3.3 整形及測(cè)頻電路

高頻段整形采用高速比較器MAX913,低頻段采用低速比較器LM311。為提高輸入MAX913信號(hào)的信噪比,在其前級(jí)加一級(jí)無限增益放大,采用高頻率運(yùn)算放大器LM7171,放大倍數(shù)50,這樣減小MAX913輸出脈沖邊沿抖動(dòng)。同時(shí),為避免高頻整形方波的諧波發(fā)射,比較器輸出均經(jīng)74LS393分頻后送入FPGA進(jìn)行等精度測(cè)頻,脈沖邊沿更陡峭,便于測(cè)量。

3.4 A/D采樣電路

A/D轉(zhuǎn)換器采樣是信號(hào)處理的重要部分,是對(duì)模擬信號(hào)進(jìn)行數(shù)字量化。采用MAx118的流水線工作模式,該模式下MAX118的工作直觀,控制簡(jiǎn)單。圖3為MAX118的實(shí)現(xiàn)電路。

利用單片機(jī)和FPGA器件實(shí)現(xiàn)等效和實(shí)時(shí)采樣方式的數(shù)字示波器設(shè)計(jì)

4 系統(tǒng)軟件設(shè)計(jì)

簡(jiǎn)化后的系統(tǒng)軟件流程如圖4所示。系統(tǒng)主體功能采用模塊化的設(shè)計(jì)思想,通過按鍵進(jìn)行選擇,且菜單界面良好,具有較強(qiáng)的人機(jī)交互性。為了在示波器上顯示穩(wěn)定的波形,采用內(nèi)觸發(fā)方式進(jìn)行掃描,軟件對(duì)觸發(fā)電平的設(shè)置較好排除硬件毛刺產(chǎn)生的干擾,觸發(fā)和波形較穩(wěn)定,且易實(shí)現(xiàn)觸發(fā)電壓的調(diào)整。另外雙端口RAM的使用還使系統(tǒng)具備自動(dòng)調(diào)節(jié)和波形存儲(chǔ)的功能。

利用單片機(jī)和FPGA器件實(shí)現(xiàn)等效和實(shí)時(shí)采樣方式的數(shù)字示波器設(shè)計(jì)

5 測(cè)試結(jié)果

5.1 使用的儀器及測(cè)試方案

PC機(jī):清華同方P1.7 G,512 M;直流穩(wěn)壓電源:SG1733SB;雙蹤示波器:泰克TDS1002;仿真機(jī):E51/S偉福;信號(hào)源:Agilent 33120A;數(shù)字合成高頻信號(hào)發(fā)生器:SP1461。

將系統(tǒng)行列掃描輸出端分別與模擬示波器X軸與y軸輸入端相連,進(jìn)行垂直靈敏度和水平掃描速度測(cè)試,信號(hào)幅值和周期測(cè)試。

5.2 測(cè)試數(shù)據(jù)及分析

表1和表2分別給出了該系統(tǒng)設(shè)計(jì)的水平靈敏度和垂直靈敏度測(cè)試數(shù)據(jù)。

利用單片機(jī)和FPGA器件實(shí)現(xiàn)等效和實(shí)時(shí)采樣方式的數(shù)字示波器設(shè)計(jì)

利用單片機(jī)和FPGA器件實(shí)現(xiàn)等效和實(shí)時(shí)采樣方式的數(shù)字示波器設(shè)計(jì)

系統(tǒng)電壓測(cè)量誤差主要于前級(jí)信號(hào)調(diào)理電路,被測(cè)信號(hào)是寬帶寬,高動(dòng)態(tài)范圍的信號(hào),因而對(duì)前級(jí)放大器幅頻特性要求很高。系統(tǒng)頻率測(cè)量的誤差于等精度測(cè)頻中對(duì)頻標(biāo)計(jì)數(shù)的±1誤差,以及比較器邊沿抖動(dòng)和工作的不穩(wěn)定性。

系統(tǒng)具有3檔垂直靈敏度,電壓測(cè)量誤差小于2%,7檔水平掃描速率,周期測(cè)量誤差小于0.01%,以及觸發(fā)電平調(diào)節(jié)和存儲(chǔ)波形的功能。

6 結(jié)束語

該數(shù)字示波器增加了垂直靈敏度和水平掃描速度的檔位、AUTOSET和光標(biāo)顯示以及對(duì)顯示波形處理的功能,顯示波形無明顯失真,幅度測(cè)量誤差小于2%,頻率測(cè)量精度優(yōu)于0.01%,并能進(jìn)行單次觸發(fā),存儲(chǔ)/調(diào)出波形。系統(tǒng)的顯示輸出采用模擬示波器和128×64點(diǎn)陣液晶相結(jié)合的方式,波形顯示清晰,工作穩(wěn)定,操作簡(jiǎn)單,人機(jī)界面友好。


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