可滿足SIL2對(duì)硬件容錯(cuò)要求的AD7124芯片
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發(fā)表于 09-07 11:28
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發(fā)表于 08-07 10:56
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AD7124-8按照19200輸出速率設(shè)置，實(shí)際五千不到怎么解決？
AD7124-8 直接說設(shè)置，
{0x01, 0x04C0, 2, 1}, 全功率，狀態(tài)和數(shù)據(jù)一起傳輸
{0x09, AD7124_CH_EN |AD7124
發(fā)表于 08-01 07:12
AD7124的程序如何將它導(dǎo)出成hex格式呢？
/platforms/SDP_K1/這個(gè)等。它的程序我也在網(wǎng)上下載下來了。參見附件。
EVAL-AD7124-3e1005bd4d41.zip
打開后是這樣的，
我的問題是，如果這個(gè)文件確實(shí)是用于AD7124的程序
發(fā)表于 07-23 08:13
AD7124-8手冊(cè)里沒提到上電時(shí)序，評(píng)估板原理圖是有上電時(shí)序的，那電路設(shè)計(jì)時(shí)是否需要上電時(shí)序？
AD7124評(píng)估板中的AVDD先上電，而后IOVDD才上電。但數(shù)據(jù)手冊(cè)中沒有體現(xiàn)，實(shí)際設(shè)計(jì)電路時(shí)候是否需要這樣設(shè)計(jì)呢？
還有一個(gè)問題，這里為啥中等功率模式的均方根值噪聲明明小于全功率模式，為啥它
發(fā)表于 07-04 08:31
AD7124-8內(nèi)部溫度傳感器如何讀取，通道配置如何設(shè)置呢？
] - 0x800000) * 10 / 13584 - 2725; //讀AD7124內(nèi)部溫度,精度0.5°C
發(fā)現(xiàn)溫度比芯片表面溫度總是低了1.5°C左右，我哪里做錯(cuò)了，請(qǐng)告訴我正常的設(shè)置，多謝！
發(fā)表于 07-04 06:52
該如何提高代碼容錯(cuò)率、降低代碼耦合度？
提高RT-Thread代碼的容錯(cuò)率和降低耦合度是確保代碼質(zhì)量和可維護(hù)性的關(guān)鍵,下面列舉了幾種在編寫代碼時(shí)，提高代碼容錯(cuò)率和降低耦合度的思路。讓我們一起來看看吧~一、提高代碼容錯(cuò)率輸入驗(yàn)證與數(shù)據(jù)校驗(yàn)
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發(fā)表于 05-13 14:19
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AduCM361的ADC校準(zhǔn)后得出的結(jié)果是錯(cuò)誤的，是什么原因?qū)е碌哪兀?/a>
AD7124和AD7794兩款A(yù)DC的校準(zhǔn)資料，對(duì)內(nèi)部校準(zhǔn)說的不是很清楚。
在進(jìn)行內(nèi)部校準(zhǔn)時(shí)，失調(diào)校準(zhǔn)是否需要將兩個(gè)輸入選擇為同一個(gè)輸入？滿量程校準(zhǔn)時(shí)如何設(shè)置輸入通道？
非常感謝！
發(fā)表于 01-12 06:50
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