有了上面的基礎(chǔ)，可以投資買開發(fā)板了，一般賣板子的都配套好軟件和編程器了。針對240的開發(fā)板可能很少，可能570的好買。注意買cpld的開發(fā)板，不要急于用fpga的，學(xué)會(huì)cpld之后，再用fpga就容易多了。要一步一步來。570的開發(fā)板，帶仿真器，帶軟件，帶練習(xí)光盤，一整套下來估計(jì)200-300元人民幣。這個(gè)資金對你要學(xué)會(huì)的技術(shù)來說，微不足道。

　　開發(fā)板光盤有許多例子程序，可以先跑跑看，很容易就上手了。對于初學(xué)者來說，cpld技術(shù)是一個(gè)很大的領(lǐng)域，切記不要急于求成，上來就弄個(gè)fpga去加載視頻編解碼算法，那會(huì)十分困難。建議先從最簡單的開始，用240替代設(shè)計(jì)中使用的一些74芯片、完成部分軟件功能等，熟能生巧。這個(gè)技術(shù)絕不是短時(shí)間就能達(dá)到多高水平的，必須有積累過程。一開始就啃難度高的，會(huì)對信心造成打擊，長時(shí)間沒有進(jìn)展，是讓一個(gè)硬件工程師最為抓狂的事。

　　對于前期學(xué)習(xí)準(zhǔn)備比較充足的工程師來說，完全可以不買開發(fā)板，直接在工程中應(yīng)用。現(xiàn)在的互聯(lián)網(wǎng)太方便了，只要你的cpld外圍沒有接錯(cuò)，由于引腳分布是可編程的，pcb板導(dǎo)致不能用的可能性就大大降低了，鼓勵(lì)直接自己畫pcb去應(yīng)用。這樣掌握得更快。

　　3：cpld與cpu的接口

　　這個(gè)問題十分重要，因?yàn)閏pld大部分扮演的是cpu的擴(kuò)展，替cpu完成外部引腳資源擴(kuò)展、輸入輸出時(shí)序管理、部分軟件功能實(shí)現(xiàn)。很少有讓一個(gè)cpld單獨(dú)工作的。

　　Cpld與cpu的接口就十分突出，對于要學(xué)cpld的工程師來說，用的cpu可能僅限于51單片機(jī)或者arm7系單片機(jī)。這種接口算是比較簡單了，還是應(yīng)該循序漸進(jìn)，從簡單的入手，比如用單片機(jī)3個(gè)io去cpld，由cpld完成74hc138功能，這就是一個(gè)簡單接口。再進(jìn)一步，用cpu的p0口和一個(gè)io腳接到cpld，用cpld完成373、244、273等功能，這就進(jìn)了一步，有時(shí)序的概念了。最后，用cpu的數(shù)據(jù)口、晶振、wr、rd、ale等信號接入cpld，把cpld做成幾個(gè)字節(jié)的ram，讀寫實(shí)驗(yàn)。這一關(guān)過去之后，cpld與單片機(jī)的接口就再無秘密可言了。

　　與51單片機(jī)的接口注意必須深刻理解cpu的工作時(shí)序，地址與數(shù)據(jù)口如何復(fù)用，ale信號如何鎖存地址等。與arm7的接口相對簡單，因arm7比較靈活，對外部接口的管理功能強(qiáng)。

　　初學(xué)者使用cpld的時(shí)候，建議在所有io腳的連線中都串聯(lián)一個(gè)51歐電阻，這樣會(huì)方便測量，更重要的是能保護(hù)cpld的io口，更深入的說，能改善高速信號的振鈴、信號反射，提高信號完整性。

　　4：cpld與fpga的簡單介紹

　　Cpld比較簡單，fpga更加復(fù)雜，在cpld基礎(chǔ)上，增加了PLL、硬件乘法器、ram塊等硬件資源。更有的fpga直接集成了dsp的硬核。Altera的max ii系列cpld，其內(nèi)部應(yīng)用了走線池，因此嚴(yán)格地說它已經(jīng)屬于fpga了。

　　目前主要的cpld和fpga廠家是altera和xilinx，還有actel等規(guī)模稍小。Altera主要面對商用和工業(yè)用，其產(chǎn)品性價(jià)比稍好，市場應(yīng)用最為廣泛。Xilinx初期定位在宇航級產(chǎn)品，因此，它的芯片具有更好的性能。后來xilinx也面對商業(yè)用戶了，因此形成了與altera分庭鼎立的情況，兩個(gè)這么大的廠家，芯片的系列十分類似。建議初學(xué)者使用altera的。當(dāng)然，使用xilinx也無所謂。

　　Altera的開發(fā)環(huán)境是quartus，筆者使用的是8.1版，已經(jīng)老了，但是夠用，且不出問題，姑且使用。Xilinx的開發(fā)環(huán)境是ISE。這些環(huán)境本身已經(jīng)提供了比較完整的仿真功能。但有一個(gè)功能更加強(qiáng)大、更加獨(dú)立的仿真環(huán)境是model sim，它分前仿真和后仿真，由于altera和xilinx的主導(dǎo)作用，因此model sim提供了這兩家的芯片的完整支持。‘前仿真’屬于邏輯仿真，所有瞬態(tài)時(shí)序同步發(fā)生，用于初期測試邏輯功能是否正確。‘后仿真’則帶有延遲特性，這與芯片內(nèi)部構(gòu)造和編譯后的內(nèi)部走線密切相關(guān)。這個(gè)后仿真，一般情況下就等同于在實(shí)際板子上跑的結(jié)果。如果在pcb上跑出現(xiàn)問題，則此問題就比較難解決。

　　軟件分兩種規(guī)范，一個(gè)是verilog hdl，一個(gè)叫vhdl。前者基本就是c語言的底子，因此對于工程師來說，很容易上手，所以用verilog的人非常多。Vhdl則更加嚴(yán)謹(jǐn)，其語言規(guī)范需要一段時(shí)間熟悉。如果要長期以hdl語言為伍，則推薦學(xué)習(xí)vhdl，它的結(jié)構(gòu)更加嚴(yán)謹(jǐn)，能避免比較復(fù)雜的問題的發(fā)生。聽一個(gè)在華為的硬件工程師說，華為要求必須熟練一個(gè)語言的同時(shí)要能看懂另一個(gè)語言。