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電子發(fā)燒友網(wǎng)>可編程邏輯>FPGA/ASIC技術(shù)>NCO的分析 - ADC中的數(shù)字下變頻的分析和其高性能優(yōu)勢

NCO的分析 - ADC中的數(shù)字下變頻的分析和其高性能優(yōu)勢

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多天線多載波的數(shù)字下變頻的FPGA實現(xiàn)

數(shù)字變頻/下變頻(DUC/DDC)是數(shù)字中頻設(shè)計的重要組成部分,其功能是將基帶信號經(jīng)過內(nèi)插濾波后變到中頻的頻率,或者將中頻的信號經(jīng)過抽取濾波后降到基帶的頻率上。本文的主要目的就是介紹多天線多載波數(shù)字
2017-11-25 02:31:01259

基于專用數(shù)字下變頻芯片GC5016的寬/窄帶數(shù)據(jù)下變頻系統(tǒng)設(shè)計及數(shù)據(jù)分析與解調(diào)

下變頻率芯片GC5016同時實現(xiàn)寬帶和窄帶信號的變頻;采用FPGA實現(xiàn)對寬/窄帶數(shù)據(jù)的接收和存儲,存儲后數(shù)據(jù)使用高性能 DSP 芯片C6455實現(xiàn)對這些數(shù)據(jù)的處理。文中詳細介紹了該系統(tǒng)的軟硬件設(shè)計方法。
2017-12-05 09:49:313044

介紹多天線多載波數(shù)字下變頻的FPGA實現(xiàn)方法

數(shù)字變頻/下變頻(DUC/DDC)是數(shù)字中頻設(shè)計的重要組成部分,其功能是將基帶信號經(jīng)過內(nèi)插濾波后變到中頻的頻率,或者將中頻的信號經(jīng)過抽取濾波后降到基帶的頻率上。本文的主要目的就是介紹多天線多載波數(shù)字下變頻的FPGA實現(xiàn)方法,以及Altera提供的一種數(shù)字信號處理的工具,DSP BUILDER。
2019-03-13 15:16:581743

重新思考快速寬頻ADC中的數(shù)字下變頻.pdf

重新思考快速寬頻ADC中的數(shù)字下變頻
2018-04-23 10:41:121

基于0.18μm CMOS工藝的無線局域網(wǎng)正交下變頻電路的設(shè)計

本文介紹了基于0.18μm CMOS工藝的802.11a無線局域網(wǎng)1GHz頻段正交下變頻電路的設(shè)計方法。該設(shè)計采用源級退化和電流注入的方法對傳統(tǒng)的吉爾伯特混頻單元進行改進,實現(xiàn)了高性能下變頻器。
2019-05-23 08:28:002499

用DSP-BUILDER實現(xiàn)多天線多載波的數(shù)字下變頻的FPGA方案

數(shù)字變頻/下變頻(DUC/DDC)是數(shù)字中頻設(shè)計的重要組成部分,其功能是將基帶信號經(jīng)過內(nèi)插濾波后變到中頻的頻率,或者將中頻的信號經(jīng)過抽取濾波后降到基帶的頻率上。本文的主要目的就是介紹多天線多載波數(shù)字
2018-09-15 04:57:002800

高性能RX和DPD集成RF前端的作用分析

高性能RX和DPD集成RF前端,包括LNA、μW下變頻器、LO和14位四通道ADC,具有相位同步功能,可為大型數(shù)據(jù)轉(zhuǎn)換器陣列提供時鐘
2019-06-14 06:01:003355

基于可編程邏輯器件實現(xiàn)數(shù)字下變頻系統(tǒng)的設(shè)計

整個軟件無線電系統(tǒng)的穩(wěn)定性產(chǎn)生直接影響。采用專用DDC器件完成數(shù)字下變頻,雖具有抽取比大、性能穩(wěn)定等優(yōu)點,但價格昂貴,靈活性不強,不能充分體現(xiàn)軟件無線電的優(yōu)勢。FPGA工藝發(fā)展迅速,處理能力大大
2020-08-06 15:31:17728

數(shù)字下變頻技術(shù)的應(yīng)用背和原理與結(jié)構(gòu)等資料詳細說明

系統(tǒng)先將射頻信號模擬混頻至統(tǒng)一的中頻信號,使用ADC器件對其采樣,采樣后的中頻信號經(jīng)過數(shù)字下變頻器即圖中的DDC模塊變?yōu)榈退俚幕鶐盘栐偎屯鵇SP進行實時信號處理它在整個軟件無線電系統(tǒng)中的主要作用
2020-09-01 16:02:007

如何在數(shù)字下變頻實現(xiàn)FPGA

研究了高倍抽取的數(shù)字下變頻設(shè)計,重點分析了基于級聯(lián)積分梳狀濾波器和級聯(lián)半帶濾波器的多級抽樣頻率算法。并提出了用最新的Systemgenerator軟件實現(xiàn)FPGA 的設(shè)計、仿真方案,縮短了開發(fā)周期
2020-11-05 17:04:5514

數(shù)字上/下變頻器簡介:VersaCOMM?可重構(gòu)數(shù)字轉(zhuǎn)換器

數(shù)字上/下變頻器簡介:VersaCOMM?可重構(gòu)數(shù)字轉(zhuǎn)換器
2021-05-12 20:53:040

AD6636:150 MSPS、寬帶、數(shù)字下變頻器(DDC)數(shù)據(jù)表

AD6636:150 MSPS、寬帶、數(shù)字下變頻器(DDC)數(shù)據(jù)表
2021-05-27 20:46:494

基于FPGA的DDC(數(shù)字下變頻)設(shè)計與實現(xiàn)

基于FPGA的DDC(數(shù)字下變頻)設(shè)計與實現(xiàn)(電源技術(shù)審稿費多少)-該文檔為基于FPGA的DDC(數(shù)字下變頻)設(shè)計與實現(xiàn)講解文檔,是一份很不錯的參考資料,具有較高參考價值,感興趣的可以下載看看………………
2021-09-15 12:04:2228

基于FPGA的數(shù)字下變頻器(DDC)的設(shè)計

基于FPGA的數(shù)字下變頻器(DDC)的設(shè)計(ups電源技術(shù)轉(zhuǎn)讓)-基于FPGA的數(shù)字下變頻器(DDC)的設(shè)計.適合新手學習參考
2021-09-16 11:43:5237

數(shù)字下變頻器是怎么回事

在本文的第一部分“數(shù)字下變頻器——第1部分”中,我們探討了行業(yè)對更高頻率RF頻段采樣的推動,以及數(shù)字下變頻器(DDC)如何實現(xiàn)這種類型的無線電架構(gòu)。討論了與AD9680系列產(chǎn)品中的DDC相關(guān)的幾個技術(shù)方面。
2023-01-05 14:28:211997

專為5G應(yīng)用設(shè)計的上/下變頻

應(yīng)用設(shè)計的上/下變頻器,它由混頻器、內(nèi)部LO以及可選的中頻和射頻濾波器組成,內(nèi)部LO具有出色的相位噪聲性能。虹科TYMTEK UD Box可以被配置為上變頻器、下變頻器或兩者同時進行。 虹科上/下變頻器TYMTEK
2023-04-10 10:12:080

下變頻器輸入信號幅度對下變頻的影響

下變頻器(Downconverter)用于將高頻信號轉(zhuǎn)換為較低頻率的信號。輸入信號的幅度(即信號的電壓或功率級別)會對下變頻的影響產(chǎn)生以下幾個方面的影響。
2023-06-07 10:18:25544

ADC數(shù)字下變頻器:重新審視復雜的抽取示例

回想一下示例中,AD9680-500的工作輸入時鐘為491.52 MHz,模擬輸入頻率為150.1 MHz。AD9680設(shè)置為使用數(shù)字下變頻器(DDC),具有實輸入、復數(shù)輸出、155 MHzNCO
2023-06-30 15:18:00717

ADC數(shù)字下變頻器:復雜抽取示例

在本例中,我們將介紹AD9680-500,其工作輸入時鐘為491.52 MHz,模擬輸入頻率為150.1 MHz。AD9680將設(shè)置為使用數(shù)字下變頻器(DDC),具有實際輸入、復數(shù)輸出、155
2023-06-30 15:20:25747

數(shù)字下變頻在人工智能引擎上的實現(xiàn)應(yīng)用說明

電子發(fā)燒友網(wǎng)站提供《數(shù)字下變頻在人工智能引擎上的實現(xiàn)應(yīng)用說明.pdf》資料免費下載
2023-09-13 15:06:310

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