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電子發燒友網>電子資料下載>可編程邏輯>EDA-教程>PCB設計規則>時鐘產生和分發設計指南

時鐘產生和分發設計指南

2009-09-06 | rar | 4332 | 次下載 | 免費

資料介紹

時鐘產生和分發設計指南:在您設計時鐘電路時是否僅僅因為某些方法在過去一直沿用,所以就采用它呢?或者您曾經使用過某個器件僅僅是因為其他設計中使用了它?這種現象在如今的設計中經常出現,特別是在時鐘發生和分發電路中。
本書是由工程師們編寫的,目標讀者是那些希望用最好的方法設計時鐘電路的工程師。它重點講述高速數字設計中時鐘發生和分發電路的實施。本書材料是從許多經過時間檢驗的設計方案中挑選出來的,同時還對可滿足更快的時鐘頻率需要的新技術進行了介紹。
最終目標是獲得純凈、穩定的時鐘?,F在,許多公司投入整個部門來專門研究信號集成,他們進行仿真、設計審查以及各種分析,以確保時鐘的最佳運行狀態。設計者應考慮到幾個影響時鐘波形的因素,本書將研討時鐘設計的若干關鍵問題。
時鐘發生器在當今的設計中起著舉足輕重的作用,在對高速度的追求中,很多系統采用了同步設計方式,隨著此方法的應用,對相同時鐘產生各種頻率以及產生許多副本的需要也隨之產生。在大多數系統中,這些時鐘需要彼此同相,否則,則將損失寶貴的周期時間。在保持所有器件以其峰值速率工作時,時鐘之間的偏斜變得非常重要。專用的時鐘緩沖器在提供純凈、精確的時鐘信號方面起著主導作用。
鎖相環的使用還最大程度地減小了時鐘之間的延時。這些器件為設計者提供了更多的靈活性,使設計者可以對齊時鐘邊沿,或者使時鐘前移或后移,從而增大數據有效窗口。它們還可以補償線路長度延時和獨特的芯片時序,時鐘緩沖器的確可以幫助工程師設計出最佳電路。
第2章討論具有低偏斜輸出和零延時緩沖器的時鐘驅動器。該章討論它們的工作原理并重點介紹某些典型應用。這兩種器件是時鐘分發的基礎,專為生成具有純凈、對稱邊沿的時鐘信號而設計。
在同步系統中,時序預算是成功滿足設定時間和保持時間的關鍵。第3章討論計算時序寬裕度時需考慮的許多因素。抖動、偏斜、相位誤差以及許多其他可變因素可能在指定周期中占用寶貴的時間。但是這些因素如何合并在一起相互影響呢?該章討論分析不同因素所需方法,還介紹了一種稱為總時序預算的新方法,此值幫助設計者確定周期時間的影響因素,同時不使其寬裕度過大。
抖動是時鐘設計中常用的術語,但是,它有很多被誤解的定義。第4章討論抖動的起因和定義,并揭開與數據手冊標簽相關的神秘面紗。對各種類型的抖動進行了討論,并介紹如何進行測量。這使設計者可以評估對設計真正有影響的各類抖動。還著重介紹了抖動的特性,以有助于隔離可能造成過度抖動的信號源。
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