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Synplify?Pro?8.1半導(dǎo)體設(shè)計及驗證軟件供應(yīng)商Synplicity公司近日對其可編程邏輯器件(PLD)綜合軟件Synplify?Pro?8.1進(jìn)行了改進(jìn)。Synplify?Pro軟件支持Verilog-2001標(biāo)準(zhǔn)以及新器件及新操作系統(tǒng)(OS)。最新版本的Synplify?Pro軟件提高了若干項QoR(最終結(jié)果質(zhì)量)，以及增效定時引擎及自動寄存器重新定時功能的增強(qiáng)，能夠提高設(shè)計人員的產(chǎn)出率，并且性能更佳。
業(yè)界領(lǐng)先的基于FPGA的ASIC原型驗證綜合工具，通過提供諸如團(tuán)隊設(shè)計、自動re-timing、快速的編譯以及額外的特性來優(yōu)化設(shè)計結(jié)果。除了具有B.E.S.T.引擎外，Synplify?pro又加入了D.S.T.(Direct?Synthesis?Technology),SCOPE(Synthesis?Constraint?Optimization?Environment),STAMP和多點優(yōu)化等技術(shù)來滿足設(shè)計者的需求。Synplify?pro提供了和布局布線工具之間的native-link接口來完成Push-Button的流程，使用戶只需要點擊就可以完成所有的綜合和布局布線的工作。基于Synplicety公司的B.E.S.T.引擎，Synplify?Pro可以輕松綜合數(shù)百萬門的設(shè)計而不需要分割。
業(yè)界領(lǐng)先的基于FPGA的ASIC原型驗證綜合工具，通過提供諸如團(tuán)隊設(shè)計、自動re-timing、快速的編譯以及額外的特性來優(yōu)化設(shè)計結(jié)果。除了具有B.E.S.T.引擎外，Synplify?pro又加入了D.S.T.(Direct?Synthesis?Technology),SCOPE(Synthesis?Constraint?Optimization?Environment),STAMP和多點優(yōu)化等技術(shù)來滿足設(shè)計者的需求。Synplify?pro提供了和布局布線工具之間的native-link接口來完成Push-Button的流程，使用戶只需要點擊就可以完成所有的綜合和布局布線的工作。基于Synplicety公司的B.E.S.T.引擎，Synplify?Pro可以輕松綜合數(shù)百萬門的設(shè)計而不需要分割。
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