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16.6 版本出來將近半年了，一直想和大家分享一下OrCAD 在16.6 上面的表現(xiàn)。今天終于可以坐下來說一下了。今天要討論的是Capture 非常有用的一個更新，原理圖與SI 分析的完美結(jié)合結(jié)合。
大家知道，當(dāng)今對PCB 設(shè)計(jì)的周期要求越來越短，信號的頻率卻在不斷的升高，對于高速PCB 設(shè)計(jì)中帶來的SI 問題也越來越關(guān)注。所以我們就會想各種方法來解決這一系列問題，既縮短PCB 設(shè)計(jì)的周期，又可以解決SI 帶來的各種問題。很自然的我們就會考慮在原理圖階段就介入SI 的分析，然后賦予高速信號一些PCB 高速設(shè)計(jì)規(guī)則。而我們知道當(dāng)前的PCB 工具只能在PCB 部分才能調(diào)用Signal Explorer 來做這些工作，現(xiàn)在我們來看看新版本是怎么完成的。
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