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華為大規模邏輯設計指導書
目的
編寫該規范的目的是提高書寫VHDL代碼的可讀性可修改性可重用性優化代碼綜合和
仿真的結果指導設計工程師使用VHDL規范代碼和優化電路規范化公司的ASIC/FPGA設計輸
入從而做到 邏輯功能正確可快速仿真 綜合結果最優 可讀性較好
2 范圍
該規范涉及VHDL編碼風格規定編碼中應注意的問題VHDL代碼書寫范例等
該規范適用于所有的采用VHDL代碼進行設計的項目
3 定義
VHDL Very high speed IC Hardware Description Language, 甚高速集成電路的硬件描述語言
FSM Finite Status Machine,有限狀態機
simulate 仿真通過輸入激勵在計算機上驗證設計是否正確包括RTL仿真和門級仿真
模擬是指對一個物理器件的結構功能或其他特性如延時特性等用抽象的語言或高級語言
如用C語言進行算法描述所進行的建模
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