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電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>基帶信號進行MPSK調制,QPSK調制(VHDL源程序)

基帶信號進行MPSK調制,QPSK調制(VHDL源程序)

2008-11-28 | rar | 33 | 次下載 | 10積分

資料介紹

基帶信號進行MPSK調制(這里M=4),即QPSK調制,基于VHDL硬件描述語言---對基帶信號進行MPSK調制(這里M=4),即QPSK調制.

library ieee;
use ieee.std_logic_arith.all;
use ieee.std_logic_1164.all;
use ieee.std_logic_unsigned.all;
entity PL_MPSK is
port(clk???? :in std_logic;???????????? --系統時鐘
???? start?? :in std_logic;???????????? --開始調制信號
???? x????? :in std_logic;???????????? --基帶信號
???? y????? :out std_logic);?????????? --調制信號
end PL_MPSK;
architecture behav of PL_MPSK is
signal q:integer range 0 to 7;??????????? --計數器
signal xx:std_logic_vector(1 downto 0);?? --中間寄存器
signal yy:std_logic_vector(1 downto 0);?? --2位并行碼寄存器
signal f:std_logic_vector(3 downto 0);??? --載波f
begin
process(clk)??????? --通過對clk分頻,得到4種相位;并完成基帶信號的串并轉換

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