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電子發燒友網>電子資料下載>可編程邏輯>FPGA/ASIC>如何寫好狀態機

如何寫好狀態機

2009-06-14 | rar | 322 | 次下載 | 10積分

資料介紹

如何寫好狀態機:狀態機是邏輯設計的重要內容,狀態機的設計水平直接反應工程師的邏輯功底,所以許多公司硬件和邏輯工程師面試中,狀態機設計幾乎是必選題目。本章在引入狀態機設計思想的基礎上,重點討論如何寫好狀態機。
本章主要內容如下:
· 狀態機的基本概念;
· 如何寫好狀態機;
· 使用 Synplify Pro 分析FSM。
6.1 狀態機的基本概念
本節的重點在于幫助讀者理解狀態機的基本概念和應用場合。
6.1.1 狀態機是一種思想方法
相信大多數工科學生在學習數字電路時都學習過狀態機的基本概念,了解一些使用狀態
機描述時序電路的基本方法。但是,筆者希望大家能擴展思維,認識到狀態機不僅僅是一種時序電路設計工具,它更是一種思想方法。
我們先看下面一個簡單的例子。在大學生活中,某學生的在校的學習生活可以簡單地概
括為宿舍、教室、食堂之間的周而復始,用圖6-1 就可以形象地表現出來。這里畫這張圖,并不是要討論這個學生是否是一個“乖乖”類型學生,請大家注意,如果將圖中的“地點”認為是“狀態”,將“功能”認為是狀態的“輸出”,這張圖就是一張標準的狀態轉移圖,也就是說,我們用狀態機的方式清晰地描述了這個學生的在校生活方式。
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