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7系列FPGA及7a35tftg256-1特性
1.改進(jìn)的高效6輸入查找表技術(shù)，可配置為分布存儲(chǔ)器。
2.內(nèi)置先入先出邏輯的36 Kb雙端口塊內(nèi)存用于片內(nèi)數(shù)據(jù)緩存。
3.高效的SelectIO技術(shù)，支持DDR3接口，采樣率高達(dá)1866 Mb/s。
4.內(nèi)置串行千兆位收發(fā)器（multi-gigabit transceivers），收發(fā)頻率從600 Mb/s到最高的6.6 Gb/s ，直到28.05 Gb/s。
5.用戶可配置的模擬輸入接口（XADC），具有雙12-bit 1MSPS 模數(shù)轉(zhuǎn)換器，并帶有內(nèi)部溫度、電壓傳感器。
6.具有DSP 專用SLICE ， 帶有 25 x 18 乘法器， 48位進(jìn)位累加器。
7.時(shí)鐘管理塊 （CMT），結(jié)合鎖相環(huán)PLL和混合模式時(shí)鐘管理器MMCM，具有高精度和低抖動(dòng)優(yōu)點(diǎn)，可實(shí)現(xiàn)分頻和倍頻、相位移動(dòng)等功能。
8.集成PCIE接口模塊。
9.大量的可配置選項(xiàng)。
10.28nm高效低功耗、低內(nèi)核電壓、低成本設(shè)計(jì)。
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