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一、實驗目的
1、掌握ISE軟件的基本使用
2、掌握內置門原語的使用
二、實驗設備
計算機一臺、V2.0實驗平臺一套、ISE軟件。
三、ISE工程建立
1、雙擊桌面ISE圖標，啟動ISE軟件如下圖1-1：
本文檔的主要內容詳細介紹的是FPGA的實驗指導書詳細資料說明。
圖1-4
從project中選擇添加資源文件new source，并選擇文件類型為Verilog Module，輸入文件名如下圖1-5。點擊NEXT進行下一步操作。
注：圖1-5中資源文件的類型有多種，各項意義如下說明：
?。?） IP（CORE Generator&Architecture Wizard）：使用ISE的IP Core工具快速生成可靠的源代碼，目前比較流行。
?。?）Schematic ：原理圖輸入。
?。?）User Document ：用戶文檔類型。
?。?）Verilog Module ：Verilog模塊類型，用于編寫Verilog hdl 代碼。
?。?）Verilog Test Fixture ：Verilog測試模塊類型，用于編寫Verilog測試代碼。
?。?）VHDL Module ：VHDL模塊類型，用于編寫VHDL 代碼。
（7）VHDL Library ：VHDL庫類型，用于制作VHDL庫。
?。?）VHDL Package ：VHDL包類型，用于制作VHDL包。
?。?）VHDL Test Fixture ：VHDL測試模塊類型，用于編寫VHDL測試代碼。
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