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本文檔的主要內容詳細介紹的是VHDL的硬件描述語言基礎詳細資料說明包括了：簡介，基本結構，基本數據類型，設計組合電路，設計時序電路，設計狀態機，大規模電路的層次化設計，Function and Procedure
傳統數字電路設計方法不適合設計大規模的系統。工程師不容易理解原理圖設計的功能。
眾多軟件公司開發研制了具有自己特色的電路硬件描述語言（ Hardware DescriptionLanguage，HDL），存在著很大的差異，工程師一旦選用某種硬件描述語言作為輸入工具，就被束縛在這個硬件設計環境之中。因此，硬件設計工程師需要一種強大的、標準化的硬件描述語言，作為可相互交流的設計環境。
用于設計復雜的、多層次的設計。支持設計庫和設計的重復使用
與硬件獨立，一個設計可用于不同的硬件結構，而且設計時不必了解過多的硬件細節。
有豐富的軟件支持VHDL的綜合和仿真，從而能在設計階段就能發現設計中的Bug，縮短設計時間，降低成本。
更方便地向ASIC過渡
VHDL有良好的可讀性，容易理解。
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