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隨著高速數(shù)據(jù)采集系統(tǒng)的快速發(fā)展及其復雜性提高，其關(guān)鍵部分高速ADC（Analog to Digital Converter，模/數(shù)轉(zhuǎn)換器）對時鐘質(zhì)量的要求也越來越高，為此提出了一種基于內(nèi)部集成2.5 GHz VCO（壓控振蕩器）的低相位噪聲鎖相環(huán)時鐘芯片AD9520[1]的高質(zhì)量時鐘電路設(shè)計，介紹了在5 Gs/s高速數(shù)據(jù)采集系統(tǒng)中AD9520的具體設(shè)計應用，包括其控制寄存器的參數(shù)配置以及初始化順序等，給出了該高速數(shù)據(jù)采集系統(tǒng)的原理框圖，并采用Xilinx公司ISE軟件中的在線邏輯分析儀（ChipScope Pro）測試了時鐘性能，實測表明整體指標達到設(shè)計要求。
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