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發(fā)視頻利用設(shè)計(jì)規(guī)則化解高速設(shè)計(jì)挑戰(zhàn)的應(yīng)用設(shè)計(jì)
2017-09-15 |
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資料介紹
對(duì)于 PCB 設(shè)計(jì)工程師和小型團(tuán)隊(duì)而言，解決 SI（信號(hào)完整性）和 EMI（電磁干擾）相關(guān)問題是一項(xiàng)每天都要面對(duì)的挑戰(zhàn)。為確定并解決 PCB 設(shè)計(jì)流程期間面臨的 Layout 挑戰(zhàn)，許多工程師都要依賴基于規(guī)則的復(fù)雜檢查。通過使用設(shè)計(jì)規(guī)則檢查 （DRC），您可以避免輻射測(cè)試失敗或信號(hào)完整性相關(guān)故障等最終產(chǎn)品問題。
本白皮書將回顧 SI/EMC 挑戰(zhàn)的常見原因，并展示如何使用八項(xiàng)高級(jí)設(shè)計(jì)規(guī)則來輕松識(shí)別這些挑戰(zhàn)，從而節(jié)省您的時(shí)間和成本。
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