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提出了一種適用于 AVS的游程解碼、反掃描、反量化和反變換硬件結(jié)構(gòu)優(yōu)化設(shè)計方案。 根據(jù) AVS整數(shù)變換和量化的特性 , 設(shè)計了可工作在不同模式的存儲器陣列 , 既可用來進(jìn)行反變 換器所需的轉(zhuǎn)置操作 , 又可用來存儲中間結(jié)果 , 將游程解碼、反掃描和反量化合并為一個流水 線單元并行處理。該設(shè)計省去了存儲中間結(jié)果所需的大量存儲器 , 加快了處理速度 , 滿足高清 視頻的處理要求。該設(shè)計通過了 FPGA驗證 , 綜合結(jié)果表明 , 其邏輯門數(shù)僅為 9076, 最高工作頻 率大于 200MHz。
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