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電子發燒友網>電子資料下載>嵌入式開發>嵌入式同步時鐘系統的設計方案

嵌入式同步時鐘系統的設計方案

2017-11-04 | rar | 0.3 MB | 次下載 | 1積分

資料介紹

 分享到:標簽嵌入式; 同步時鐘
  同步時鐘系統是同步設備中實現同步通信的核心,因此,要實現數字同步網的設備同步就要求同步時鐘系統一方面要能提供精確的定時同步,另一方面還要能方便實現網絡管理中心對同步時鐘的管理。本文詳細介紹了利用嵌入式微控制器MSP430單片機和數字鎖相環(DPLL)來實現嵌入式同步時鐘系統的方案和設計實例。
  系統總體結構
  同步設備的同步時鐘系統要求能達到3級時鐘標準,可使用從SDH網絡上提取的時鐘或外部時鐘源來作為同步的基準時鐘信號,同時也可以通過時鐘模塊自振來產生時鐘信號。產生的這些同步時鐘信號為同步設備進行SDH傳輸和為設備各單板提供同步時鐘源,同時同步時鐘系統還要能夠通過以太網口和網管通信,從而實現對同步時鐘系統的網絡管理。為了使時鐘系統能穩定可靠地工作,通常還要求有兩塊時鐘板同時在線,一塊處于正常工作狀態,另一塊則處于熱備份工作狀態。隨時可以 進行時鐘的無縫切換。
  在功能上,本系統可以分為I/O接口模塊、時鐘定時模塊和控制通信模塊三部分。系統結構如圖1所示。
  嵌入式同步時鐘系統的設計方案
  圖1 嵌入式同步時鐘系統結構圖
  I/O接口模塊
  本模塊由時標選擇和分頻控制驅動兩部分組成。時標選擇部分主要完成對外部輸入時鐘信號的緩沖、解碼,通過單片機選擇其中的一路輸入產生DPLL的參考時標。該系統可支持2路SDH上傳輸的19440KHz信號輸入和2路G.703標準的2048KHz或2048Kbps的信號(支持75W和120W兩種阻抗比配方式)。
  分頻控制驅動部分對DPLL給出的信號進行分頻,形成19.44MHz和6.48MHz信號,根據主/備用信號控制輸出。最后由驅動電路形成8路19.44MHz和10路6.48MHz的輸出信號送交同步設備各單板。
  時鐘定時模塊
  DPLL完成時鐘定時模塊的核心功能。DPLL利用外來的時標信號,使其處于跟蹤方式工作;同時也可利用單片機將控制信號送到其內部,使其運行在保持或自由振蕩方式。DPLL在工作的同時又給出自身的工作狀態,如跟蹤、保持、自由振蕩、失鎖、失效、丟失外標信號等情況報告,通過將這些信息送交單片機再上報給網管系統來實現對時鐘系統的監控。
  控制通信模塊
  此模塊包括單片機和以太網接口模塊兩部分,主要完成主備時鐘板間的通信、監控并上報時鐘工作狀態、接收并執行網管下發的指令。通過以太網接口和網管通信,將網管下發的指令處理后分發給各時鐘模塊,同時再把從時鐘模塊收集來的信息上報給網管。
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