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基于CPLD/FPGA的半整數(shù)分配器設(shè)計(jì)與實(shí)現(xiàn)

2021-04-12 | rar | 0.38 MB | 次下載 | 免費(fèi)

資料介紹

簡要介紹了CPLD/FPGA器件的特點(diǎn)和應(yīng)用范圍,并以分頻比為25和15的分頻器的設(shè)計(jì)為例,介紹了在 Maxplus開發(fā)軟件下,利用VHDL硬件描述語言以及原理圖的輸入方式來設(shè)計(jì)數(shù)字邏輯電路的過程和方法該設(shè)計(jì)具有結(jié)構(gòu)簡單、實(shí)現(xiàn)方便、便于系統(tǒng)升級的特點(diǎn)。

基于CPLD/FPGA的半整數(shù)分頻器設(shè)計(jì)與實(shí)現(xiàn)

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