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交錯式ADC之間的帶寬失配應該是對于設計師而言最難解決的失配問題。 如圖1所示，帶寬失配具有增益和相位/頻率分量。這使得解決帶寬失配問題變得更為困難，因為它含有兩個來自其他失配參數的分量：增益和時序失配。
然而，在帶寬失配中，可在不同的頻率下看到不同增益值。 此外，帶寬具有時序分量，使不同頻率下的信號通過每個轉換器時具有不同的延遲。 最大程度降低帶寬失配的最好辦法，是極為出色地進行電路設計并完成布局布線實踐，這樣可以最大程度降低ADC之間的帶寬失配。 ADC之間的匹配越好，則產生的雜散就越少。由于增益和時序隨頻率變化而發生改變，任何試圖校準誤差的算法種類都極為復雜。 這樣可能會過多地增加電路和面積開銷，從而抵消校準的優勢。 因此，正確的布局技術有助于減少這類失配，并充分考慮到其他類型的失配（失調、增益和時序），對交錯雜散也有很大的影響。交錯式ADC中有四個主要失配包括帶寬失配、失調失配、增益失配與時序失配，而這些失配也有些許共同之處。 四個失配中有三個會在fS/2 ± fin的輸出頻譜中產生雜散。 輕易就能識別出失調失配雜散，因為只有它位于fS/2，并可十分方便地對其進行補償。 增益、時序和帶寬失配都會在輸出頻譜的fS/2 ± fin中產生雜散;因此，隨之而來的問題是：如何識別它們各自的影響？ 圖2以簡單的圖形方式指導如何從交錯式ADC的不同失配中識別雜散來源。
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