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賽靈思可編程器件含有數(shù)百萬個(gè)邏輯單元 (LC)，集成了當(dāng)前越來越多的復(fù)雜電子系統(tǒng)。本高層次生產(chǎn)力設(shè)計(jì)方法提供 了在短設(shè)計(jì)周期內(nèi)開發(fā)此類復(fù)雜系統(tǒng)的一套最佳做法。 這種方法以下列概念為重點(diǎn)：
? 對(duì)寶貴的差異化邏輯使用并行開發(fā)流程，實(shí)現(xiàn)您的產(chǎn)品在市場(chǎng)上的差異化，且 shell 可用于將 IP 與生態(tài)系統(tǒng)的其 它部分集成。
? 廣泛使用基于 C 語言的 IP 開發(fā)流程開發(fā)差異化邏輯，讓仿真速度相對(duì)于 RTL 仿真成倍增長(zhǎng)，并且能提供時(shí)序準(zhǔn)確 和得到優(yōu)化的 RTL。
? 使用現(xiàn)有的預(yù)驗(yàn)證、塊和組件級(jí) IP 來快速構(gòu)建 shell，將差異邏輯封裝在系統(tǒng)中。
? 使用腳本，針對(duì)從準(zhǔn)確設(shè)計(jì)驗(yàn)證直至編程 FPGA 的流程實(shí)現(xiàn)高度自動(dòng)化。
? 對(duì)寶貴的差異化邏輯使用并行開發(fā)流程，實(shí)現(xiàn)您的產(chǎn)品在市場(chǎng)上的差異化，且 shell 可用于將 IP 與生態(tài)系統(tǒng)的其 它部分集成。
? 廣泛使用基于 C 語言的 IP 開發(fā)流程開發(fā)差異化邏輯，讓仿真速度相對(duì)于 RTL 仿真成倍增長(zhǎng)，并且能提供時(shí)序準(zhǔn)確 和得到優(yōu)化的 RTL。
? 使用現(xiàn)有的預(yù)驗(yàn)證、塊和組件級(jí) IP 來快速構(gòu)建 shell，將差異邏輯封裝在系統(tǒng)中。
? 使用腳本，針對(duì)從準(zhǔn)確設(shè)計(jì)驗(yàn)證直至編程 FPGA 的流程實(shí)現(xiàn)高度自動(dòng)化。
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