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浮點(diǎn)加法是數(shù)字信號處理中的一種非常頻繁且非常重要的操作，在現(xiàn)代數(shù)字信號處理應(yīng)用中，浮點(diǎn)加法運(yùn)算幾乎占到全部浮點(diǎn)操作的一半以上。浮點(diǎn)乘法器是高性能DSP（數(shù)字信號處理器）的重要部件，是實(shí)時(shí)處理的核心，其速度直接影響DSP的速度，因此國內(nèi)外學(xué)者對提高浮點(diǎn)乘加單元的性能進(jìn)行了大量的研究。浮點(diǎn)運(yùn)算單元的設(shè)計(jì)主要是在速度和所占用資源之間進(jìn)行權(quán)衡。
本文以實(shí)時(shí)信號處理為應(yīng)用背景，首先介紹了單精度浮點(diǎn)格式，然后從速度和占用資源這兩個(gè)角度出發(fā)，詳細(xì)介紹了浮點(diǎn)乘法單元和浮點(diǎn)加法單元的流水線結(jié)構(gòu)。經(jīng)過仿真驗(yàn)證，在V irte x-4系列FPGA（現(xiàn)場可編程門陣列）上，浮點(diǎn)加法器的最高運(yùn)行速率達(dá)到405 MHz，而浮點(diǎn)乘法器的最高運(yùn)行速率達(dá)到429 MHz。
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