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利用Allegro實現(xiàn)嵌入式系統(tǒng)高速電路設(shè)計

2009-08-26 | rar | 198 | 次下載 | 10積分

資料介紹

本文首先簡述了高性能ARM9微處理器EP9315集成的外設(shè)接口硬件結(jié)構(gòu)框架,提出了當(dāng)前高速電路設(shè)計中的問題;然后,詳細(xì)介紹了利用Allegro實現(xiàn)嵌入式系統(tǒng)SDRAM和IDE總線接口的電路設(shè)計;最后以Cirrus Logic公司的CS8952為例,闡述了物理層接口芯片的布線準(zhǔn)則及其在Allegro中的實現(xiàn)。
關(guān)鍵詞:嵌入式系統(tǒng); Allegro;等長;差分對;阻抗控制
隨著嵌入式微處理器主頻的不斷提高,信號的傳輸處理速度越來越快,當(dāng)系統(tǒng)時鐘頻率
達(dá)到100 MHZ 以上,傳統(tǒng)的電路設(shè)計方法和軟件已無法滿足高速電路設(shè)計的要求。在高速電路設(shè)計中,走線的等長、關(guān)鍵信號的阻抗控制、差分走線的設(shè)置等越來越重要。筆者所在的武漢華中科技大學(xué)與武漢中科院巖土力學(xué)所智能儀器室合作,以ARM9 微處理器EP9315 為核心的嵌入式系統(tǒng)完成工程檢測儀的開發(fā)。其中在該嵌入式系統(tǒng)硬件電路設(shè)計中的SDRAM 和IDE 等長走線、關(guān)鍵信號的阻抗控制和差分走線是本文的重點,同時以cirrus logic 公司的網(wǎng)絡(luò)物理層接口芯片cs8952 為例詳細(xì)介紹了網(wǎng)絡(luò)部分的硬件電路設(shè)計,為同類高速硬件電路設(shè)計提供了一種可借鑒的方法。
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