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在系統(tǒng)芯片的設(shè)計(jì)中，傳統(tǒng)的激勵(lì)發(fā)生機(jī)制耗費(fèi)人工多且難以重用，嚴(yán)重影響了仿真驗(yàn)證的效率。針對此問題，構(gòu)建了一種基于可重用激勵(lì)發(fā)生機(jī)制的虛擬SoC驗(yàn)證平臺。該平臺利用可重用的激勵(lì)發(fā)生模塊調(diào)用端口激勵(lì)文件，仿真時(shí)將端口激勵(lì)文件轉(zhuǎn)換成對應(yīng)于驗(yàn)證電路端口的時(shí)序信號。通過對通用同步／異步串行接收／發(fā)送器、中斷及定時(shí)器等功能模塊的驗(yàn)證，證明了激勵(lì)發(fā)生機(jī)制具有較強(qiáng)的可觀察性、可控制性及可重用性。驗(yàn)證結(jié)果分析表明，在驗(yàn)證不同的功能點(diǎn)時(shí)僅需修改固件及端口激勵(lì)文件，使驗(yàn)證平臺在重用時(shí)減少代碼修改量，提高了靈活性和驗(yàn)證效率，縮短了系統(tǒng)芯片的驗(yàn)證時(shí)間。
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