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一種基于偽布爾可滿足性FPGA布線算法

2010-02-24 | rar | 221 | 次下載 | 3積分

資料介紹

為了克服布爾可滿足性算法在現(xiàn)場(chǎng)可編程門(mén)陣列布線中存在的不足,引進(jìn)了一種在標(biāo)準(zhǔn)對(duì)稱(chēng)陣列(隔離島狀)現(xiàn)場(chǎng)可編程門(mén)陣列結(jié)構(gòu)下的新型有效布線方法——偽布爾可滿足性算法,并結(jié)合實(shí)例詳細(xì)地闡述了將其應(yīng)用于布線的原理及方法,同時(shí)采用實(shí)際工業(yè)電路將布爾可滿足性算法與偽布爾可滿足性算法作出比較。實(shí)驗(yàn)結(jié)果顯示,偽布爾可滿足性算法比布爾可滿足性算法在布線時(shí)間上減少了10.5%,在穩(wěn)定性上提高了3.3%。
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