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隨著半導(dǎo)體工藝水平的不斷發(fā)展，3D芯片技術(shù)已成為一大研究熱點(diǎn)。“綁定中測試”環(huán)節(jié)的提出對于芯片的測試流程有了新的要求。但是，“綁定中測試”“一綁一測”的特點(diǎn)會使部分裸片被重復(fù)測試，從而帶來測試時間的增加。從“綁定中測試”的過程出發(fā)，協(xié)同考慮測試功耗與“理論制造成本”對于“綁定中測試”的影響，提出“多綁一測”的測試流程。在此基礎(chǔ)上提出相應(yīng)的廣度優(yōu)先遍歷算法，結(jié)合ITC02電路的相關(guān)參數(shù)，體現(xiàn)本文思想在實際生產(chǎn)制造中的現(xiàn)實意義。
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