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標(biāo)簽 > 數(shù)字設(shè)計(jì)
數(shù)字設(shè)計(jì)是20世紀(jì)90年代以來設(shè)計(jì)領(lǐng)域出現(xiàn)的一種新的設(shè)計(jì)方式,它跨越“藝術(shù)學(xué)”和“計(jì)算機(jī)科學(xué)與技術(shù)”兩個(gè)性質(zhì)完全不同的一級學(xué)科,涉及到包裝、廣告、印刷、出版、影視、游戲、互聯(lián)網(wǎng)、建筑、室內(nèi)裝飾、工業(yè)設(shè)計(jì)、紡織、服裝等絕大部分相關(guān)視覺設(shè)計(jì)的行業(yè)。
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在數(shù)字設(shè)計(jì)中,fifo是數(shù)據(jù)操作任務(wù)所需的普遍結(jié)構(gòu),如跨時(shí)鐘域、低延遲內(nèi)存緩沖和總線寬度轉(zhuǎn)換...
數(shù)字設(shè)計(jì)系統(tǒng)中常見的兩種傳輸線結(jié)構(gòu)是微帶線和帶狀線。微帶線分為標(biāo)準(zhǔn)微帶線和嵌入式微帶線。前者是指PCB外層的走線,...
2023-09-01 標(biāo)簽:結(jié)構(gòu)傳輸線數(shù)字設(shè)計(jì) 747 0
數(shù)字設(shè)計(jì)系統(tǒng)中常見的兩種傳輸線結(jié)構(gòu)是微帶線和帶狀線。微帶線分為標(biāo)準(zhǔn)微帶線和嵌入式微帶線。前者是指PCB外層的走線,它...
2023-08-29 標(biāo)簽:傳輸線數(shù)字設(shè)計(jì)PCB 894 0
在數(shù)字系統(tǒng)級別的時(shí)鐘域交叉(CDC)中,亞穩(wěn)態(tài)傳播問題是一個(gè)重要的挑戰(zhàn)。在這個(gè)問題中,由于時(shí)序差異,信號在觸發...
常見的時(shí)鐘產(chǎn)生電路有哪些 PLL/DLL電路的優(yōu)缺點(diǎn)
雙沿時(shí)鐘使得原本一個(gè)周期輸出/輸入一個(gè)數(shù)據(jù)的架構(gòu),改變?yōu)橐粋€(gè)周期輸出/輸入兩個(gè)數(shù)據(jù),這樣在不升高時(s...
ASIC數(shù)字設(shè)計(jì):前端設(shè)計(jì)、驗(yàn)證、后端實(shí)現(xiàn)
數(shù)字系統(tǒng)設(shè)計(jì)中有三個(gè)重要的設(shè)計(jì)級別概念:行為級(Behavior Level)、寄存器傳輸級(Register Transfer Le...
ASIC設(shè)計(jì)開發(fā)流程介紹 CMOS集成電路的功耗來源
集成電路是由硅晶圓(wafer)切割出來的芯片(die)組成的。每個(gè)晶圓可以切割出數(shù)百個(gè)芯片。
verilogHDL用于FPGA設(shè)計(jì)時(shí)的知識點(diǎn)匯總
里面ChatGPT的回答,第一章作為基礎(chǔ)部分,就一筆帶過了。主要就是一些器件介紹,語法和設(shè)計(jì)方法,這部分也是最容易掌握的部分。
2023-06-29 標(biāo)簽:fpga數(shù)字設(shè)計(jì)VerilogHDL 562 0
詳解數(shù)字設(shè)計(jì)中的時(shí)鐘與約束
數(shù)字設(shè)計(jì)中的時(shí)鐘與約束 本文作者 IClearner 在此特別鳴謝 最近做完了synopsys的DC workshop,涉及到時(shí)鐘的建模/約束,這里就來...
2023-01-28 標(biāo)簽:fpga時(shí)鐘數(shù)字設(shè)計(jì) 3230 0
如何創(chuàng)建FPGA內(nèi)核/SoC所需的所有常用組件
LiteX 框架為創(chuàng)建 FPGA 內(nèi)核/SoC、探索各種數(shù)字設(shè)計(jì)架構(gòu)和創(chuàng)建完整的基于 FPGA 的系統(tǒng)提供了...
2022-09-13 標(biāo)簽:fpga定時(shí)器數(shù)字設(shè)計(jì) 1777 0
數(shù)字設(shè)計(jì)之時(shí)鐘約束和時(shí)鐘類型介紹
1. 時(shí)鐘介紹 在數(shù)字設(shè)計(jì)中,時(shí)鐘代表從寄存器(register)到寄存器可靠傳輸數(shù)據(jù)的時(shí)間基準(zhǔn)。Xilinx ...
2020-11-29 標(biāo)簽:寄存器數(shù)字設(shè)計(jì) 7544 0
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