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標簽 > ip核
IP就是知識產(chǎn)權核或知識產(chǎn)權模塊的意思,在EDA技術開發(fā)中具有十分重要的地位。美國著名的Dataquest咨詢公司將半導體產(chǎn)業(yè)的IP定義為“用于ASIC或FPGA中的預先設計好的電路功能模塊”。
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RAM-Based Shift Register Xilinx IP核的使用
一般來講,如果要實現(xiàn)移位寄存器的話,通常都是寫RTL用reg來構造,比如1bit變量移位一個時鐘周期就用1個reg,也就是一個寄存器FF資源,而移位16...
Xilinx 7系列FPGA PCIe Gen3的應用接口及特性
Xilinx7系列FPGA集成了新一代PCI Express集成塊,支持8.0Gb/s數(shù)據(jù)速率的PCI Express 3.0。本文介紹了7系列FPGA...
數(shù)字芯片設計驗證經(jīng)驗分享(第三部分):將ASIC IP核移植到FPGA上——如何確保性能與時序以完成充滿挑戰(zhàn)的
本篇文章是SmartDV數(shù)字芯片設計經(jīng)驗分享系列文章的第三篇,將繼續(xù)分享第五、第六主題,包括確保在FPGA上實現(xiàn)所需的性能和時鐘兩個方面的考量因素。
Distributed Memory Generator IP核簡介
Distributed Memory Generator IP 核采用 LUT RAM 資源創(chuàng)建各種不同的存儲器結構。IP可用來創(chuàng)建只讀存儲器 (ROM...
FIFO(First In First Out, 先入先出 ),是一種數(shù)據(jù)緩沖器,用來實現(xiàn)數(shù)據(jù)先入先出的讀寫方式。數(shù)據(jù)按順序寫入 FI...
本文開源一個FPGA項目:UDP萬兆光通信。該項目實現(xiàn)了萬兆光纖以太網(wǎng)數(shù)據(jù)回環(huán)傳輸功能。Vivado工程代碼結構和之前開源的《UDP RGMII千...
本文介紹一個FPGA 開源項目:Micro Blaze最小系統(tǒng)。MicroBlaze是Xilinx提供的一個軟核IP,該軟核是由FPGA片內邏輯資源組成...
2023-09-01 標簽:fpgaXilinxMicroBlaze 3382 0
本文介紹一個FPGA開源項目:UDP千兆以太網(wǎng)光通信。利用SFP接口,可以通過使用SFP轉RJ45模塊或者直接使用光纖進行以太網(wǎng)通信。
2023-08-31 標簽:fpga接口千兆以太網(wǎng) 5017 0
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