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為什么要同時存在m_sequencer和p_sequencer他們兩個？

在構建復雜的sequence序列的時候，我們經常會用到m_sequencer和p_sequencer，并且在很多資料中都提到兩者實際指向的是同一個對象，...

2023-06-19 標簽：UVM Verilog語言 1845 0

數字IC驗證之UVM概述

UVM提供了實現 **覆蓋驅動驗證（coverage-driven verification ，CDV）** 的框架。 CDV結合了自動測試向量生成，自...

2023-06-25 標簽：IC設計 UVM Verilog語言 1791 0

探討always和always_ff的編碼風格

數字門級電路可分為兩大類：組合邏輯和時序邏輯。鎖存器是組合邏輯和時序邏輯的一個交叉點，在后面會作為單獨的主題處理。

2023-02-03 標簽：鎖存器 RTL Verilog語言 1784 0

簡述進行?IC設計的方法和設計流程

IC設計是一門非常復雜的科學，在IC生產流程中，IC芯片主要由專業IC設計公司進行規劃、設計，如聯發科、高通、Intel等國際知名大廠，都自行設計各自專...

2023-07-19 標簽：CMOS IC設計 EDA工具 1774 0

ASIC和FPGA到底選哪個好？兩者的流程有什么區別？

ASIC (Application Specific Integrated Circuit)，即專用集成電路，是指應特定用戶要求和特定電子系統的需要而設...

2023-09-02 標簽：FPGA設計存儲器 ASIC芯片 1770 0

SystemVerilog構建大型電路

構建一個從 0 到 999（含）計數的計數器，周期為 1000 個周期。復位輸入是同步的，應該將計數器復位為 0。

2023-03-09 標簽：計數器時序電路狀態機 1743 0

continue和break跳轉語句介紹

跳轉語句允許程序代碼跳過一個或多個編程語句，SystemVerilog的jump語句是continue、break和disable。

2022-11-09 標簽：鎖存器編程語言 Verilog語言 1683 0

SystemVerilog里的regions以及events的調度

本文講一下SystemVerilog的time slot里的regions以及events的調度。SystemVerilog語言是根據離散事件執行模型定...

2023-07-12 標簽：EDA工具仿真器 Verilog語言 1653 0

Systemverilog中的Driving Strength講解

在systemverilog中，net用于對電路中連線進行建模，driving strength(驅動強度)可以讓net變量值的建模更加精確。

2023-06-14 標簽：驅動器仿真器 Verilog語言 1646 0

看看兩個使用Verilog HDL設計的簡單電路

與非門的Verilog 描述如下圖所示，源程序文件的后綴為.v。

2023-09-17 標簽：D觸發器時序邏輯電路 Module 1642 0

SystemVerilog中可以嵌套的數據結構

SystemVerilog中除了數組、隊列和關聯數組等數據結構，這些數據結構還可以嵌套。

2022-11-03 標簽：Verilog語言 1634 0

如何測試函數的正確與否呢

要通過寫測試文件來檢驗函數的正確與否。這樣的方法不僅在matlab中有效，對于c、verilog等語言都有效。

2022-11-03 標簽：寄存器 ITU Verilog語言 1623 0

Testbench編寫指南（2）讀取txt文件數據

用“數組”來表述Verilog HDL中的定義并不準確，但對大多數人來說應該更好理解。

2023-09-02 標簽：存儲器二進制 HDL 1619 0

ChatGPT在后端設計中有什么應用？

本以為ChatGPT對于IC后端設計幫助應該不大，畢竟它非常依賴EDA工具，它對于EDA工具這種非常專業的、非常Custom的東西了解和訓練的數據應該不...

2023-03-07 標簽：EDA工具 Verilog語言 VHDL源碼 1575 0

優秀的Verilog/FPGA開源項目-MATH庫介紹

數字信號處理（ Digital Signal Processing)技術廣泛地應用于通信與信息系統、信號與信息處理、自動控制、雷達、軍事、航空航天、醫...

2023-06-19 標簽：dsp fpga 數字信號處理器 1533 0

SystemVerilog語言中的Upcasting和Downcasting概念解析

要想理解清楚SystemVerilog語言中的Upcasting和Downcasting概念，最好的方式從內存分配的角度理解。

2022-11-24 標簽：Verilog語言 1530 0

關于CRC硬件并行化運算的實現方法的探討

數據校驗的基礎運算原理是模2運算，也就是異或運算。

2023-06-20 標簽：CRC校驗 Verilog語言 LSFR算法 1512 0

如何通過仿真器理解Verilog語言的思路

要想深入理解Verilog就必須正視Verilog語言同時具備硬件特性和軟件特性。

2022-07-07 標簽：仿真器硬件調試器 1503 0

SystemVerilog中的tagged Unions是什么

tagged union包含一個隱式成員，該成員存儲tag，也就是標記，它表示這個union最終存儲的到底是哪一個成員。

2022-11-10 標簽：仿真器 Verilog語言 1488 0

SystemVerilog中的聯合(union)介紹

在 SystemVerilog 中，聯合只是信號，可通過不同名稱和縱橫比來加以引用。

2023-10-08 標簽：RTL Verilog語言 1436 0

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IoT是Internet of Things的縮寫，字面翻譯是“物體組成的因特網”，準確的翻譯應該為“物聯網”。物聯網（Internet of Things）又稱傳感網，簡要講就是互聯網從人向物的延伸。
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