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Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數字系統硬件的結構和行為的語言，用它可以表示邏輯電路圖、邏輯表達式，還可以表示數字邏輯系統所完成的邏輯功能。

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一個合格FPGA 工程師的基本要求

一個合格的FPGA工程師需要掌握哪些知識？這里根據自己的一些心得總結一下，其他朋友可以補充啊。

2017-02-11 標簽：FPGA Verilog 5180 0

FPGA開發與學習連載4

Verilog中，用always塊設計組合邏輯電路時，在賦值表達式右端參與賦值的所有信號都必須在always @(敏感電平列表)中列出,always中i...

2017-02-11 標簽：FPGA Verilog 540 0

FPGA開發與學習連載：Verilog設計經驗談

Verilog中，用always塊設計組合邏輯電路時，在賦值表達式右端參與賦值的所有信號都必須在 always @(敏感電平列表)中列出,always中...

2017-02-11 標簽：FPGA Verilog 883 0

Verilog的兩個誤區

Reg類型只在過程塊中被賦值;而Net類型則在過程塊外面被賦值或者驅動.

2017-02-11 標簽：Verilog 2330 0

用Verilog語言實現奇數倍分頻電路3分頻、5分頻、7分頻 9

分頻器是FPGA設計中使用頻率非常高的基本設計之一，盡管在目前大部分設計中，廣泛使用芯片廠家集成的鎖相環資源，如賽靈思（Xilinx）的DLL.來進行時...

2017-02-11 標簽：Verilog 分頻電路 1.2萬 0

Verilog設計中的一些避免犯錯的小技巧

這是一個在設計中常犯的錯誤列表，這些錯誤常使得你的設計不可靠或速度較慢，為了提高你的設計性能和提高速度的可靠性你必須確定你的設計通過所有的這些檢查。

2017-02-11 標簽：FPGA Verilog 625 0

賽靈思Verilog(FPGA/CPLD)設計技巧

以下是一個在設計中常犯的錯誤列表這些錯誤常使得你的設計不可靠或速度較慢為了提高你的設計性能和提高速度的可靠性你必須確定你的設計通過所有的這些檢查。

2017-02-11 標簽：FPGA 賽靈思 Verilog 1204 0

基于verilog的FPGA編程經驗總結

用了半個多月的ISE，幾乎全是自學起來的，碰到了很多很多讓人DT好久的小問題，百度也百不到，后來還是都解決了，為了盡量方便以后的剛學ISE的童鞋不再因為...

2017-02-11 標簽：FPGA verilog 1493 0

淺談VHDL/Verilog的可綜合性以及對初學者的一些建議

最近在寫代碼的時候總是在思考，我寫的這個能被綜合嗎？總是不放心，或是寫完了綜合的時候出問題，被搞的非常煩惱，雖然看了一些書，比如對組合邏輯用阻塞賦值，時...

2017-02-11 標簽：Verilog HDL VHDL 6759 1

針對賽靈思ISE工具的verilog編程經驗小結

2017-02-11 標簽：賽靈思 verilog ISE 3758 0

賽靈思公司提供的Verilog(FPGA/CPLD)設計小技巧

這是一個在設計中常犯的錯誤列表這些錯誤常使得你的設計不可靠或速度較慢為了提高你的設計性能和提高速度的可靠性你必須確定你的設計通過所有的這些檢查。

2017-02-11 標簽：FPGA 賽靈思 Verilog 445 0

verilog語言實現任意分頻

原文出自：分頻器是指使輸出信號頻率為輸入信號頻率整數分之一的電子電路。在許多電子設備中如電子鐘、頻率合成器等，需要各種不同頻率的信號協同工作，常用的方法...

2017-02-11 標簽：分頻器 verilog 電子電路 1.4萬 0

深入分析verilog阻塞和非阻塞賦值

學verilog 一個月了，在開發板上面寫了很多代碼，但是始終對一些問題理解的不夠透徹，這里我們來寫幾個例子仿真出阻塞和非阻塞的區別

2017-02-11 標簽：verilog 阻塞非阻塞 1423 0

cordic算法verilog實現（復雜版）

module cordic (clk,rst_n,ena,phase_in,sin_out,cos_out,eps); parameter DATA_W...

2017-02-11 標簽：verilog cordic 4384 0

cordic算法verilog實現（簡單版）

cordic算法verilog實現（簡單版）(轉載）module cordic(clk, phi, cos, sin); parameter W = ...

2017-02-11 標簽：verilog cordic 3276 0

按鍵消抖的原理和基于verilog的消抖設計

按鍵開關是各種電子設備不可或缺的人機接口。在實際應用中，很大一部分的按鍵是機械按鍵。在機械按鍵的觸點閉合和斷開時，都會產生抖動，為了保證系統能正確識別按...

2017-02-11 標簽：verilog 2.3萬 0

此通用電路可以實現任意奇數分頻電路

最近正在準備找工作，由于是做FPGA開發，所以verilog實現技術分頻電路是一道經常出現的題目，三分頻，五分頻電路等等；經過一下午時間總結出了一個通用...

2017-02-09 標簽：FPGA verilog 分頻電路 2719 0

Verilog HDL語言的文件調用問題：include使用方法介紹

本文簡單介紹在使用Verilog HDL語言時文件的調用問題之include使用方法介紹及舉例說明，詳見本文...

2013-01-24 標簽：Verilog 源代碼預處理 6891 0

基于Verilog計算精度可調的整數除法器的設計

除法器是電子技術領域的基礎模塊，在電子電路設計中得到廣泛應用。目前，實現除法器的方法有硬件實現和軟件實現兩種方法。硬件實現的方法主要是以硬件的消耗為代價...

2012-05-24 標簽：Verilog 精度可調整數除法器 2022 0

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