verilog

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Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語言，用它可以表示邏輯電路圖、邏輯表達(dá)式，還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。

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verilog技術(shù)

vhdl和verilog的區(qū)別_vhdl和verilog哪個(gè)好？

VHDL全名Very-High-Speed Integrated Circuit Hardware Description Language，誕生于19...

2018-03-23 標(biāo)簽：verilog vhdl 12.4萬 0

verilog語言基本語句_verilog語言詞匯大全

Verilog HDL是一種硬件描述語言（HDL:Hardware Description Language），以文本形式來描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為...

2018-03-23 標(biāo)簽：verilog verilog語言 9.5萬 1

verilog是什么_verilog的用途和特征是什么

本文首先介紹了verilog的概念和發(fā)展歷史，其次介紹了verilog的特征與Verilog的邏輯門級描述，最后介紹了Verilog晶體管級描述與ver...

2018-05-14 標(biāo)簽：verilog HDL 描述語言 4.5萬 0

vivado調(diào)用IP核詳細(xì)介紹

大家好，又到了每日學(xué)習(xí)的時(shí)間了，今天咱們來聊一聊vivado 調(diào)用IP核。首先咱們來了解一下vivado的IP核，IP核（IP Core）：Vivad...

2018-05-28 標(biāo)簽：Verilog IP核 vivado 3.7萬 0

初學(xué)者學(xué)習(xí)Verilog HDL的步驟和經(jīng)驗(yàn)技巧

Verilog HDL是一種硬件描述語言（HDL:Hardware Discription Language），Verilog HDL語言是一種以文本形...

2017-02-11 標(biāo)簽：Verilog HDL VHDL 3.6萬 1

Verilog和VHDL之間如何互轉(zhuǎn)

當(dāng)然階段四純屬個(gè)人的對未來的推測，但是，近年來，F(xiàn)PGA也高速發(fā)展，明顯有當(dāng)年匯編語言開發(fā)到C高級語言開發(fā)的趨勢，我們是不是應(yīng)該不局限于只學(xué)習(xí)FPG...

2018-11-12 標(biāo)簽：Verilog C語言 VHDL 2.5萬 0

按鍵消抖的原理和基于verilog的消抖設(shè)計(jì)

按鍵開關(guān)是各種電子設(shè)備不可或缺的人機(jī)接口。在實(shí)際應(yīng)用中，很大一部分的按鍵是機(jī)械按鍵。在機(jī)械按鍵的觸點(diǎn)閉合和斷開時(shí)，都會(huì)產(chǎn)生抖動(dòng)，為了保證系統(tǒng)能正確識(shí)別按...

2017-02-11 標(biāo)簽：verilog 2.3萬 0

告訴你真正的verilog執(zhí)行順序，糾正你的思路偏差

同時(shí)大家要明白verilog不是不能實(shí)現(xiàn)順序執(zhí)行，而是實(shí)現(xiàn)順序執(zhí)行并不像語法那么直觀，最簡單的順序執(zhí)行方法就是用狀態(tài)機(jī)去控制每一個(gè)寄存器的跳變，C/C...

2018-08-31 標(biāo)簽：寄存器 verilog 編譯器 2.2萬 1

Verilog generate語句的類型

Generate 結(jié)構(gòu)在創(chuàng)建可配置的RTL的時(shí)候很有用。Generate loop能夠讓語句實(shí)例化多次，通過index來控制。而conditio...

2018-03-16 標(biāo)簽：Verilog 2.2萬 0

簡談FPGA的上電復(fù)位

大家好，博主最近有事忙了幾天，沒有更新，今天正式回來了。那么又到了每日學(xué)習(xí)的時(shí)間了，今天咱們來聊一聊簡談FPGA的上電復(fù)位，歡迎大家一起交流學(xué)習(xí)。在...

2018-06-18 標(biāo)簽：FPGA verilog 2.0萬 0

Verilog可綜合的循環(huán)語句

Verilog中提供了四種循環(huán)語句，可用于控制語句的執(zhí)行次數(shù)，分別為：for，while，repeat，forever。其中，for，while，rep...

2019-10-13 標(biāo)簽：verilog 2.0萬 0

簡談FPGA verilog中的function用法與例子

大家好，又到了每日學(xué)習(xí)的時(shí)間了，今天我們來聊一聊FPGA verilog中的function用法與例子。函數(shù)的功能和任務(wù)的功能類似，但二者還存在很大的...

2018-08-10 標(biāo)簽：fpga Verilog 1.9萬 0

通過編寫verilog代碼實(shí)現(xiàn)OLED驅(qū)動(dòng)和內(nèi)容顯示的解決方案

本實(shí)驗(yàn)通過verilog代碼的編寫，在EGO1開發(fā)板上實(shí)現(xiàn)OLED的驅(qū)動(dòng)和內(nèi)容顯示。

2017-11-11 標(biāo)簽：OLED Verilog OLED驅(qū)動(dòng) 1.9萬 1

關(guān)于verilog中的無符號(hào)數(shù)和有符號(hào)數(shù)

在數(shù)字電路中，出于應(yīng)用的需要，我們可以使用無符號(hào)數(shù)，即包括0及整數(shù)的集合；也可以使用有符號(hào)數(shù)，即包括0和正負(fù)數(shù)的集合。在更加復(fù)雜的系統(tǒng)中，也許這兩種類型...

2020-11-18 標(biāo)簽：Verilog 數(shù)字電路 1.7萬 0

基于Verilog FPGA 流水燈設(shè)計(jì)

流水廣告燈主要應(yīng)用于LED燈光控制。通過程序控制LED的亮和滅，多個(gè)LED燈組成一個(gè)陣列，依次逐個(gè)點(diǎn)亮的時(shí)候像流水一樣，所以叫流水燈。由于其形成美觀大...

2017-08-09 標(biāo)簽：fpga verilog 流水燈 1.7萬 0

使用Verilog來實(shí)現(xiàn)EEPROM的讀寫，進(jìn)行一個(gè)簡單的I2C實(shí)戰(zhàn)應(yīng)用

傳送器件地址ID_Address，器件地址的最后一位為數(shù)據(jù)的傳輸方向位，R/W，低電平0表示主機(jī)往從機(jī)寫數(shù)據(jù)（W），1表示主機(jī)從從機(jī)讀數(shù)據(jù)（R）。這里按...

2018-08-31 標(biāo)簽：Verilog EEPROM 1.6萬 0

verilog編譯指令_verilog編譯器指示語句（數(shù)字IC）

以`（反引號(hào)）開始的某些標(biāo)識(shí)符是編譯器指令。在Verilog 語言編譯時(shí)，特定的編譯器指令在整個(gè)編譯過程中有效（編譯過程可跨越多個(gè)文件），直到遇到其它的...

2018-03-23 標(biāo)簽：verilog 編譯器 verilog語言 1.5萬 0

Verilog和SystemVerilog定義了4種描述信號(hào)狀態(tài)

在實(shí)際設(shè)計(jì)中有一種情況可能會(huì)產(chǎn)生這種問題：cond信號(hào)來自于memory。比如漢明碼SECDED（single error correction do...

2018-03-29 標(biāo)簽：寄存器 Verilog 1.5萬 0

verilog語言實(shí)現(xiàn)任意分頻

原文出自：分頻器是指使輸出信號(hào)頻率為輸入信號(hào)頻率整數(shù)分之一的電子電路。在許多電子設(shè)備中如電子鐘、頻率合成器等，需要各種不同頻率的信號(hào)協(xié)同工作，常用的方法...

2017-02-11 標(biāo)簽：分頻器 verilog 電子電路 1.4萬 0

一文詳解帶復(fù)位的SR觸發(fā)器和JK觸發(fā)器

　　圖1是基本SR觸發(fā)器及其真值表。

2023-01-31 標(biāo)簽：Verilog JK觸發(fā)器觸發(fā)器 1.4萬 0

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Protues

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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