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VHDL全名Very-High-Speed Integrated Circuit Hardware Description Language，誕生于1982年。1987年底，VHDL被IEEE和美國國防部確認(rèn)為標(biāo)準(zhǔn)硬件描述語言。

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IAR Embedded Workbench 將支持RISC-V太空級處理器 NOEL-V

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2022年10月26日，中國廣州，廣東高云半導(dǎo)體科技股份有限公司（以下簡稱“高云半導(dǎo)體”）宣布與Metrics Design Automation公司（...

2022-10-26 標(biāo)簽：fpga 仿真器 eda 1360 0

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Moku Cloud Complie是Moku:Pro上的一項創(chuàng)新功能。Moku是測試工具是基于FPGA的儀器，Moku Cloud Complie允許...

2022-10-11 標(biāo)簽：vhdl 云編譯 1326 0

VHDL和Verilog中數(shù)組定義、初始化、賦值方法

方法：實際應(yīng)用里，通常需要在上電復(fù)位過程中對變量進行初始化，如果數(shù)組個數(shù)少時，直接賦初始值即可，但是數(shù)組個數(shù)多時，可以用循環(huán)實現(xiàn)賦值,通常的循環(huán)語句有F...

2022-09-23 標(biāo)簽：Verilog vhdl 數(shù)組 1.1萬 0

智能行業(yè)將數(shù)據(jù)放在首位

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芯片實現(xiàn)碼代碼的部分

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2022-08-23 標(biāo)簽：芯片 vhdl 代碼 2432 0

Vivado仿真器進行混合語言仿真的一些要點

本文主要介紹使用 Vivado 仿真器進行混合語言仿真的一些要點。

2022-08-01 標(biāo)簽：仿真器 vhdl Vivado 1329 0

關(guān)于VHDL編碼風(fēng)格

區(qū)別來了，很明顯，第一份代碼因為用output <= output + 1的原因，左右兩端使用了相同的信號，混淆當(dāng)前狀態(tài)和下一狀態(tài)，下一狀態(tài)被隱藏...

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Vivado BDC (Block Design Container)怎么用

談到BDC（Block DesignContainer）就不得不提IPI（IP Integrator）。IPI常被翻譯為“IP集成器”，也是有道理的。它...

2021-11-09 標(biāo)簽：Verilog vhdl OOC 4547 0

開源工具SkiDL - 用Python來描述電路

我們用Verilog、VHDL這種硬件描述語言來設(shè)計FPGA，是否有一種方式來描述電路？如果采用了這種方式，也會像HDL在FPGA、ASIC領(lǐng)域一樣成為...

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使用Vivado仿真器進行混合語言仿真的一些要點

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在最近召開的RISC-V中國峰會上，中科院計算所的包云崗研究員團隊正式發(fā)布了名為“香山”的開源高性能處RISC-V處理器。前不久我有幸和包老師就這個事情...

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VHDL與Verilog硬件描述語言如何用TestBench來進行仿真

VHDL與Verilog硬件描述語言在數(shù)字電路的設(shè)計中使用的非常普遍，無論是哪種語言，仿真都是必不可少的。而且隨著設(shè)計復(fù)雜度的提高，仿真工具的重要性就越...

2021-08-04 標(biāo)簽：vhdl 3824 0

Verilog HDL verilog hdl和vhdl的區(qū)別

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2021-07-23 標(biāo)簽：VHDL Verilog HDL 1.1萬 0

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淺析Vivado在非工程模式下的FPGA設(shè)計流程

參考：UG892 UG835 Vivado集成開發(fā)工具為設(shè)計者提供了非工程模式下的FPGA設(shè)計流程。在Vivado非工程模式下，F(xiàn)PGA開發(fā)人員可以更加...

2021-06-19 標(biāo)簽：fpga vhdl DRC 2613 0

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2021-06-15 標(biāo)簽：Verilog vhdl 5187 0

淺析modelsim 自動化高效獨立仿真含vivado IP核的工程

1.modelsim編譯vivado庫 1）雙擊啟動vivado軟件，如下圖操作。 2）Simulator：選對應(yīng)的， Language：都選all， ...

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深度解讀VHDL語言的卷積碼和Viterbi譯碼的實現(xiàn)

介紹并用VHDL語言實現(xiàn)了卷積編碼和維特比譯碼。根據(jù)編碼器特征設(shè)計了一種具有針對性的簡潔的維特比譯碼器結(jié)構(gòu)，

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進行靜電中和等。
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　　SDK一般指軟件開發(fā)工具包，軟件開發(fā)工具包一般都是一些軟件工程師為特定的軟件包、軟件框架、硬件平臺、操作系統(tǒng)等建立應(yīng)用軟件時的開發(fā)工具的集合。軟件開發(fā)工具廣義上指輔助開發(fā)某一類軟件的相關(guān)文檔、范例和工具的集合。
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