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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級集成電路、軟件設(shè)計工具以及作為預(yù)定義系統(tǒng)級功能的IP(Intellectual Property)核。
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Xilinx FPGA平臺DDR3設(shè)計保姆式教程(一)
DDR3全稱double-data-rate 3 synchronous dynamic RAM,即第三代雙倍速率同步動態(tài)隨機(jī)存儲器。所謂同步,是指DD...
Xilinx SystemVerilog中的基本聯(lián)合體
在 SystemVerilog 中,聯(lián)合體只是信號,可通過不同名稱和縱橫比來加以引用。 其工作方式為通過 typedef 來聲明聯(lián)合,并提供不同標(biāo)識符用...
Xilinx平臺Aurora IP介紹(一)Aurora基礎(chǔ)知識
Aurora 是一個用于在點(diǎn)對點(diǎn)串行鏈路間移動數(shù)據(jù)的可擴(kuò)展輕量級鏈路層協(xié)議。這為物理層提供透明接口,讓專有協(xié)議或業(yè)界標(...
Xilinx平臺Aurora IP介紹(二)時鐘與復(fù)位
對于我們使用Xilinx或其他的成熟IP而言,IP相當(dāng)于一個黑匣子,內(nèi)部實(shí)現(xiàn)的邏輯功能我們知道,但是控制不了,只能默認(rèn)OK;一般而言,成熟IP都是...
Xilinx平臺Aurora IP介紹(三)Aurora配置及接口
開門見山的說,跟DDR/PCIE/GTX這種復(fù)雜的IP相比,Aurora配置那是相當(dāng)?shù)暮唵巍W咧?/p>
同時GTX復(fù)位也挺隨意的,你想怎么復(fù)位都可以,支持整體復(fù)位,單個組件復(fù)位。我們也可以不復(fù)位,核不會因為我們沒有進(jìn)行軟復(fù)位就不對核進(jìn)行...
2022-03-01 標(biāo)簽:fpga數(shù)據(jù)Xilinx 2044 1
首先回想一下,在平常的設(shè)計中我們是不是經(jīng)常采用同步復(fù)位或者異步復(fù)位的寫法,這一寫法似乎都已經(jīng)形成了肌肉記憶----每次我們寫always塊的時候總是會...
隨著電子行業(yè)技術(shù)的發(fā)展,特別是在傳輸接口的發(fā)展上,IEEE1284被 USB 接口取代,PATA被 SATA 取代,PCI被 PCI-Express 所...
2022-02-19 標(biāo)簽:轉(zhuǎn)換器Xilinx仿真 1.2萬 0
Xilinx SD-FEC硬核在5G-NR通信系統(tǒng)中的應(yīng)用
本文主要描述如何應(yīng)用Xilinx的SD-FEC集成塊硬核資源,進(jìn)行5G-NR 通信系統(tǒng)PDSCH和PUSCH信道編解碼開發(fā)。主要從SD-FEC集成塊硬核...
《Xilinx—UG471中文翻譯》(1)IDELAYE2原語介紹
SelectIO,就是I/O接口以及I/O邏輯的總稱。《UG471--SelectIO》 篇可以分成3部分:第1部分介紹I/O的電氣特性,第2部分介紹I...
使用Xilinx Vivado 創(chuàng)建自己板卡文件—以EBAZ4205為例
我們在使用Vivado創(chuàng)建工程時,每次都需要選擇相關(guān)的板卡器件,比較麻煩,這篇文章就教你怎么創(chuàng)建屬于自己的板卡文件,在創(chuàng)建工程時就可以像官方...
《Xilinx—UG471中文翻譯》(2)ISERDESE2原語介紹
本文僅對UG471 第3章《Advanced SelectIO Logic Resources》部分進(jìn)行翻譯和學(xué)習(xí)解讀
2022-02-16 標(biāo)簽:數(shù)據(jù)Xilinx 4233 0
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