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FPGA設計論壇

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AXI——Advanced eXtensible Interface,直譯過來就是先進的可擴展接口,....
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基于FPGA的SPI協議實現

SPI(Serial Peripheral Interface)——串行外圍設備接口。是Motoro....
的頭像 FPGA設計論壇 發表于 03-14 14:07 ?7143次閱讀

FPGA設計方法優于ASIC的一些優勢

隨著FPGA器件在資源和性能方面的進步,最新FPGA已經開始提供可以輕松定制的“平臺”解決方案,用于....
的頭像 FPGA設計論壇 發表于 03-11 10:59 ?1787次閱讀

深入了解GPU、FPGA和ASIC

隨著百度、Google、Facebook、微軟等企業開始切入人工智能,人工智能可應用的領域非常廣泛。....
的頭像 FPGA設計論壇 發表于 03-11 10:54 ?1965次閱讀

FPGA, CPU, GPU, ASIC區別,為什么使用FPGA?

PGA常年來被用作專用芯片(ASIC)的小批量替代品,然而近年來在微軟、百度等公司的數據中心大規模部....
的頭像 FPGA設計論壇 發表于 03-11 10:49 ?1570次閱讀

GPU服務器與FPGA云服務器的區別介紹

GPU 云服務器(GPU Cloud Computing)是基于 GPU 應用的計算服務,具有實時高....
的頭像 FPGA設計論壇 發表于 03-11 09:48 ?1471次閱讀

簡述Verilog HDL中阻塞語句和非阻塞語句的區別

? 在Verilog中有兩種類型的賦值語句:阻塞賦值語句(“=”)和非阻塞賦值語句(“=”)。正確地....
的頭像 FPGA設計論壇 發表于 12-02 18:24 ?6276次閱讀
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FPGA相對于MCU的主要優勢在哪

在開發新的電子系統時,設計人員需要做出各種決定。最關鍵的一個決定是選擇系統架構和實現的芯片。這些組件....
的頭像 FPGA設計論壇 發表于 11-08 10:09 ?8565次閱讀

FPGA扇出太多引起的時序問題

1.扇出太多引起的時序問題。 信號驅動非常大,扇出很大,需要增加驅動能力,如果單純考慮驅動能力可以嘗....
的頭像 FPGA設計論壇 發表于 10-25 16:30 ?9593次閱讀

UART和波特率兩者如何區分

什么是 UART UART是一種通用串行數據總線,用于異步通信。該總線雙向通信,可以實現全雙工傳輸和....
的頭像 FPGA設計論壇 發表于 10-19 17:54 ?4206次閱讀

探究關于數字電路的一些基礎知識

1.常用門電路圖 2.邏輯代數的基本定理----化簡時比較好用 反演定理:對于任意一個邏輯式 Y,若....
的頭像 FPGA設計論壇 發表于 10-11 15:04 ?5099次閱讀
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簡述FPGA時鐘約束時鐘余量超差解決方法

在設計FPGA項目的時候,對時鐘進行約束,但是因為算法或者硬件的原因,都使得時鐘約束出現超差現象,接....
的頭像 FPGA設計論壇 發表于 10-11 14:52 ?3569次閱讀
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FPGA時序約束的概念和基本策略

A 時序約束的概念和基本策略 時序約束主要包括周期約束(FFS到FFS,即觸發器到觸發器)和偏移約束....
的頭像 FPGA設計論壇 發表于 09-30 15:17 ?5127次閱讀

FPGA如何使用RAM分區循環移位法實現解交織器

本文分析了卷積交織和解交織的基本原理,然后采用Altera 的FPGA器件,用RAM分區循環移位法來....
的頭像 FPGA設計論壇 發表于 09-28 17:53 ?2836次閱讀

eFPGA能針對特定子市場或相鄰市場量身打造SoC

嵌入式FPGA (eFPGA)由于可為人工智能(AI)工作負載提供支持與靈活度,這項業務正開始掀起波....
的頭像 FPGA設計論壇 發表于 09-28 17:50 ?1659次閱讀

如何檢測集成電路的好壞

一、不在路檢測 這種方法是在ic未焊入電路時進行的,一般情況下可用測量各引腳對應于接地引腳之間的正、....
的頭像 FPGA設計論壇 發表于 09-28 17:47 ?3669次閱讀

EDA技術進行系統的設計的幾個特點

EDA技術進行系統的設計,具有以下幾個特點: 1. 軟件硬化,硬件軟化 軟件硬化是指所有的軟件設計最....
的頭像 FPGA設計論壇 發表于 09-28 17:19 ?12597次閱讀

System Verilog與verilog的對比

SystemVerilog語言簡介 SystemVerilog是一種硬件描述和驗證語言(HDVL),....
的頭像 FPGA設計論壇 發表于 09-28 17:12 ?3557次閱讀

采用FPGA協處理器實現算法加速教程

當今的設計工程師受到面積、功率和成本的約束,不能采用GHz級的計算機實現嵌入式設計。在嵌入式系統中,....
的頭像 FPGA設計論壇 發表于 09-28 10:38 ?4064次閱讀
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介紹3種方法跨時鐘域處理方法

跨時鐘域處理是FPGA設計中經常遇到的問題,而如何處理好跨時鐘域間的數據,可以說是每個FPGA初學者....
的頭像 FPGA設計論壇 發表于 09-18 11:33 ?22336次閱讀
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FPGA中同步異步時鐘域信號的處理

最常用的約束有IO管腳位置約束和電平幅度約束,這個很好理解。另外,就是對時鐘網絡約束。這個是很重要的....
的頭像 FPGA設計論壇 發表于 09-13 09:29 ?6707次閱讀

你們知道FIFO最小深度計算嗎

FIFO 最小深度計算 例子 - 1:f_wr 》 f_rd,連續讀寫 寫時鐘80MHz。 讀時鐘5....
的頭像 FPGA設計論壇 發表于 09-10 09:23 ?2066次閱讀
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在FPGA設計中FIFO的使用技巧

FIFO是在FPGA設計中使用的非常頻繁,也是影響FPGA設計代碼穩定性以及效率等得關鍵因素。在數據....
的頭像 FPGA設計論壇 發表于 09-09 11:15 ?6999次閱讀

FPGA中ROM與RAM相關知識匯總

一、基本概念 最熟悉的兩個詞語應該是RAM與ROM,RAM(Random Access Memory....
的頭像 FPGA設計論壇 發表于 09-08 11:12 ?8282次閱讀

FPGA芯片配置分類及配置方式

廣義的來說,FPGA的配置包括直接使用下載電纜對FPGA器件進行編程、對外部EEPROM和FLASH....
的頭像 FPGA設計論壇 發表于 09-06 09:41 ?6723次閱讀

FPGA的硬件架構和工作原理

一、FPGA的硬件架構和工作原理 1.1早期的PROM技術實現 在上世紀60年代以后,小規模集成電路....
的頭像 FPGA設計論壇 發表于 08-10 16:41 ?5212次閱讀
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VHDL與Verilog硬件描述語言如何用TestBench來進行仿真

VHDL與Verilog硬件描述語言在數字電路的設計中使用的非常普遍,無論是哪種語言,仿真都是必不可....
的頭像 FPGA設計論壇 發表于 08-04 14:16 ?3856次閱讀

異步FIFO用格雷碼的原因有哪些

異步FIFO通過比較讀寫地址進行滿空判斷,但是讀寫地址屬于不同的時鐘域,所以在比較之前需要先將讀寫地....
的頭像 FPGA設計論壇 發表于 08-04 14:05 ?4458次閱讀

FPGA設計中的電源管理

過去,FPGA設計者主要關心時序和面積使用率問題。但隨著FPGA不斷取代ASSP和ASIC器件,設計....
的頭像 FPGA設計論壇 發表于 07-28 10:39 ?5748次閱讀

簡述低功耗FPGA設計技術

芯片對功耗的苛刻要求源于產品對功耗的要求。集成電路的迅速發展以及人們對消費類電子產品的需求日新月異,....
的頭像 FPGA設計論壇 發表于 07-28 10:30 ?4733次閱讀
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